參數(shù)資料
型號(hào)： PIC18F6310
廠商： Microchip Technology Inc.
英文描述： 64/80-Pin Flash Microcontrollers with nanoWatt Technology
中文描述： 64/80-Pin閃存微控制器與納瓦技術(shù)
文件頁(yè)數(shù)： 77/404頁(yè)
文件大小： 3268K
代理商： PIC18F6310
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2004 Microchip Technology Inc.
Preliminary
DS39635A-page 75
PIC18F6310/6410/8310/8410
SPBRG1
EUSART1 Baud Rate Generator
0000 0000
59, 213
RCREG1
EUSART1 Receive Register
0000 0000
59, 220
TXREG1
EUSART1 Transmit Register
xxxx xxxx
59, 218
TXSTA1
CSRC
TX9
TXEN
SYNC
SENDB
BRGH
TRMT
TX9D
xxxx xxxx
59, 210
RCSTA1
SPEN
RX9
SREN
CREN
ADDEN
FERR
OERR
RX9D
0000 0000
59, 211
IPR3
—
—
RC2IP
TX2IP
—
—
—
CCP3IP
--00 ---1
59, 114
PIR3
—
—
RC2IF
TX2IF
—
—
—
CCP3IF
--00 ---1
59, 108
PIE3
—
—
RC2IE
TX2IE
—
—
—
CCP3IE
--00 ---1
59, 111
IPR2
OSCFIP
CMIP
—
—
BCLIP
HLVDIP
TMR3IP
CCP2IP
11-- 1111
59, 113
PIR2
OSCFIF
CMIF
—
—
BCLIF
HLVDIF
TMR3IF
CCP2IF
00-- 0000
59, 107
PIE2
OSCFIE
CMIE
—
—
BCLIE
HLVDIE
TMR3IE
CCP2IE
00-- 0000
59, 110
IPR1
PSPIP
ADIP
RC1IP
TX1IP
SSPIP
CCP1IP
TMR2IP
TMR1IP
1111 1111
59, 112
PIR1
PSPIF
ADIF
RC1IF
TX1IF
SSPIF
CCP1IF
TMR2IF
TMR1IF
0000 0000
59, 106
PIE1
MEMCON
(2)
PSPIE
ADIE
RC1IE
TX1IE
SSPIE
CCP1IE
TMR2IE
TMR1IE
0000 0000
59, 109
EBDIS
—
WAIT1
WAIT0
—
—
WM1
WM0
0-00 --00
59, 89
OSCTUNE
TRISJ
(2)
TRISH
(2)
INTSRC
PLLEN
(3)
—
TUN4
TUN3
TUN2
TUN1
TUN0
00-0 0000
33, 59
Data Direction Control Register for PORTJ
1111 1111
59, 139
Data Direction Control Register for PORTH
1111 1111
59, 137
TRISG
—
—
—
Data Direction Control Register for PORTG
---1 1111
60, 135
TRISF
Data Direction Control Register for PORTF
1111 1111
60, 133
TRISE
Data Direction Control Register for PORTE
1111 1111
60, 131
TRISD
Data Direction Control Register for PORTD
1111 1111
60, 128
TRISC
Data Direction Control Register for PORTC
1111 1111
60, 125
TRISB
Data Direction Control Register for PORTB
TRISA7
(5)
TRISA6
(5)
1111 1111
60, 122
TRISA
LATJ
(2)
LATH
(2)
Data Direction Control Register for PORTA
1111 1111
60, 119
Read PORTJ Data Latch, Write PORTJ Data Latch
xxxx xxxx
60, 139
Read PORTH Data Latch, Write PORTH Data Latch
xxxx xxxx
60, 137
LATG
—
—
—
Read PORTG Data Latch, Write PORTG Data Latch
---x xxxx
60, 135
LATF
Read PORTF Data Latch, Write PORTF Data Latch
xxxx xxxx
60, 133
LATE
Read PORTE Data Latch, Write PORTE Data Latch
xxxx xxxx
60, 131
LATD
Read PORTD Data Latch, Write PORTD Data Latch
xxxx xxxx
60, 128
LATC
Read PORTC Data Latch, Write PORTC Data Latch
xxxx xxxx
60, 125
LATB
Read PORTB Data Latch, Write PORTB Data Latch
LATA7
(5)
LATA6
(5)
xxxx xxxx
60, 122
LATA
PORTJ
(2)
PORTH
(2)
Read PORTA Data Latch, Write PORTA Data Latch
xxxx xxxx
60, 119
Read PORTJ pins, Write PORTJ Data Latch
xxxx xxxx
60, 139
Read PORTH pins, Write PORTH Data Latch
xxxx xxxx
60, 137
PORTG
—
—
RG5
(4)
Read PORTG pins <4:0>, Write PORTG Data Latch <4:0>
--xx xxxx
60, 135
PORTF
Read PORTF pins, Write PORTF Data Latch
xxxx xxxx
60, 133
PORTE
Read PORTE pins, Write PORTE Data Latch
xxxx xxxx
60, 131
PORTD
Read PORTD pins, Write PORTD Data Latch
xxxx xxxx
60, 128
PORTC
Read PORTC pins, Write PORTC Data Latch
xxxx xxxx
60, 125
PORTB
Read PORTB pins, Write PORTB Data Latch
RA7
(5)
RA6
(5)
xxxx xxxx
60, 122
PORTA
Read PORTA pins, Write PORTA Data Latch
xx0x 0000
60, 119
TABLE 5-3:
REGISTER FILE SUMMARY (PIC18F6310/6410/8310/8410) (CONTINUED)
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Details
on page:
Legend:
Note
x
= unknown,
u
= unchanged,
-
= unimplemented,
q
= value depends on condition. Shaded locations are unimplemented, read as ‘
0
’.
The SBOREN bit is only available when the BOREN1:BOREN0 configuration bits =
01
; otherwise it is disabled and reads as ‘
0
’. See
Section 4.4 “Brown-out Reset (BOR)”
.
These registers and/or bits are not implemented on 64-pin devices, read as ‘
0
’.
The PLLEN bit is only available in specific oscillator configuration; otherwise, it is disabled and reads as ‘
0
’. See
Section 2.6.4 “PLL in
INTOSC Modes”
.
The RG5 bit is only available when Master Clear is disabled (MCLRE configuration bit =
0
); otherwise, RG5 reads as ‘
0
’. This bit is
read-only.
RA6/RA7 and their associated latch and direction bits are individually configured as port pins based on various primary oscillator modes.
When disabled, these bits read as ‘
0
’.
STKFUL and STKUNF bits are cleared by user software or by a POR.
1:
2:
3:
4:
5:
6:
相關(guān)PDF資料
PDF描述
PIC18F8310 64/80-Pin Flash Microcontrollers with nanoWatt Technology
PIC18F66J60 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet
PIC18F66J65 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet
PIC18F67J60 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet
PIC18F67J60T 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PIC18F6310-E/PT 功能描述:8位微控制器 -MCU 16kBF 768RM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F6310-I/PT 功能描述:8位微控制器 -MCU 16kBF 768RM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F6310-I/PT 制造商:Microchip Technology Inc 功能描述:8 Bit Microcontroller Clock Speed:40MHz
PIC18F6310T-I/PT 功能描述:8位微控制器 -MCU 16kBF 768RM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F6390-E/PT 功能描述:8位微控制器 -MCU 16kBF 768RM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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