參數資料
型號: PIC18LF4682-I/PT
廠商: Microchip Technology
文件頁數: 47/183頁
文件大?。?/td> 0K
描述: IC PIC MCU FLASH 40KX16 44TQFP
產品培訓模塊: Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標準包裝: 160
系列: PIC® 18F
核心處理器: PIC
芯體尺寸: 8-位
速度: 40MHz
連通性: CAN,I²C,SPI,UART/USART
外圍設備: 欠壓檢測/復位,HLVD,POR,PWM,WDT
輸入/輸出數: 36
程序存儲器容量: 80KB(40K x 16)
程序存儲器類型: 閃存
EEPROM 大?。?/td> 1K x 8
RAM 容量: 3.25K x 8
電壓 - 電源 (Vcc/Vdd): 2 V ~ 5.5 V
數據轉換器: A/D 11x10b
振蕩器型: 內部
工作溫度: -40°C ~ 85°C
封裝/外殼: 44-TQFP
包裝: 托盤
產品目錄頁面: 646 (CN2011-ZH PDF)
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PIC18F46J50 FAMILY
DS39931D-page 140
2011 Microchip Technology Inc.
TABLE 10-5:
PORTB I/O SUMMARY
Pin
Function
TRIS
Setting
I/O
Type
Description
RB0/AN12/
INT0/RP3
RB0
1
I
TTL
PORTB<0> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<0> data output; not affected by analog input.
AN12
1
I
ANA
A/D Input Channel 12.(1)
INT0
1
I
ST
External Interrupt 0 input.
RP3
1
I
ST
Remappable Peripheral Pin 3 input.
0
O
DIG
Remappable Peripheral Pin 3 output.
RB1/AN10/
PMBE/RTCC/
RP4
RB1
1
I
TTL
PORTB<1> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<1> data output; not affected by analog input.
AN10
1
I
ANA
A/D Input Channel 10.(1)
PMBE(3)
0
O
DIG
Parallel Master Port byte enable output.
RTCC
0
O
DIG
Real-Time Clock Calender output.
RP4
1
I
ST
Remappable Peripheral Pin 4 input.
0
O
DIG
Remappable Peripheral Pin 4 output.
RB2/AN8/
CTED1/PMA3/
VMO/REFO/
RP5
RB2
1
I
TTL
PORTB<2> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<2> data output; not affected by analog input.
AN8
1
I
ANA
A/D Input Channel 8.(1)
CTED1
1
I
ST
CTMU Edge 1 input.
PMA3(3)
0
O
DIG
Parallel Master Port address.
VMO
0
O
DIG
External USB transceiver D – data output.
REFO
0
O
DIG
Reference output clock.
RP5
1
I
ST
Remappable Peripheral Pin 5 input.
0
O
DIG
Remappable Peripheral Pin 5 output.
RB3/AN9/
CTED2/PMA2/
VPO/RP6
RB3
0
O
DIG
LATB<3> data output; not affected by analog input.
1
I
TTL
PORTB<3> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
AN9
1
I
ANA
A/D Input Channel 9.(1)
CTED2
1
I
ST
CTMU Edge 2 input.
PMA2(3)
0
O
DIG
Parallel Master Port address.
VPO
0
I
DIG
External USB transceiver D+ data output.
RP6
1
I
ST
Remappable Peripheral Pin 6 input.
0
O
DIG
Remappable Peripheral Pin 6 output.
Legend:
DIG = Digital level output; TTL = TTL input buffer; ST = Schmitt Trigger input buffer; ANA = Analog level
input/output; x = Don’t care (TRIS bit does not affect port direction or is overridden for this option)
Note 1:
Pins are configured as analog inputs by default on POR. Using these pins for digital inputs requires setting
the appropriate bits in the ANCONx register first.
2:
All other pin functions are disabled when ICSP or MPLAB ICD are enabled.
3:
This functionality is only available on 44-pin devices.
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