參數資料
型號： PIC18LF8310T-I/PT
廠商： Microchip Technology
文件頁數： 89/411頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 4KX16 80TQFP
標準包裝： 1,200
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，HLVD，POR，PWM，WDT
輸入/輸出數： 70
程序存儲器容量： 8KB（4K x 16）
程序存儲器類型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數據轉換器： A/D 12x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-TQFP
包裝： 帶卷 (TR)
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2010-2012 Microchip Technology Inc.
DS39977F-page 179
PIC18F66K80 FAMILY
RB4/AN9/C2INA/
ECCP1/P1A/CTPLS/
KBI0
RB4
0
O
DIG
LATB<4> data output.
1
I
ST
PORTB<4> data input; weak pull-up when RBPU bit is cleared.
AN9
1
I
ANA
A/D Input Channel 9 and Comparator C2+ input. Default input
configuration on POR; not affected by analog output.
C2INA(1)
2
I
ANA
Comparator 2 Input A.
ECCP1(1)
0
O
DIG
ECCP1 compare output and ECCP1 PWM output. Takes priority
over port data.
1
I
ST
ECCP1 capture input.
P1A(1)
0
O
DIG
ECCP1 Enhanced PWM output, Channel A. May be configured for
tri-state during Enhanced PWM shutdown events. Takes priority
over port data.
CTPLS
x
O
DIG
CTMU pulse generator output.
KBI0
1
I
ST
Interrupt-on-pin change.
RB5/T0CKI/T3CKI/
CCP5/KBI1
RB5
0
O
DIG
LATB<5> data output.
1
I
ST
PORTB<5> data input; weak pull-up when RBPU bit is cleared.
T0CKI(3)
x
I
ST
Timer0 clock input.
T3CKI(4)
x
I
ST
Timer3 clock input.
CCP5
0
O
DIG
CCP5 compare/PWM output. Takes priority over port data.
1
I
ST
CCP5 capture input.
KBI1
1
I
ST
Interrupt-on-pin change.
RB6/PGC/TX2/CK2/
KBI2
RB6
0
O
DIG
LATB<6> data output.
1
I
ST
PORTB<6> data input; weak pull-up when RBPU bit is cleared.
PGC
x
I
ST
Serial execution (ICSP) clock input for ICSP and ICD operation.
TX2(1)
0
O
DIG
Asynchronous serial data output (EUSARTx module); takes priority
over port data.
CK2(1)
0
O
DIG
Synchronous serial clock output (EUSARTx module); user must
configure as an input.
1
I
ST
Synchronous serial clock input (EUSARTx module); user must
configure as an input.
KBI2
1
I
ST
Interrupt-on-pin change.
RB7/PGD/T3G/RX2/
DT2/KBI3
RB7
0
O
DIG
LATB<7> data output.
1
I
ST
PORTB<7> data input; weak pull-up when RBPU bit is cleared.
PGD
x
O
DIG
Serial execution data output for ICSP and ICD operation.
x
I
ST
Serial execution data input for ICSP and ICD operation.
T3G
x
I
ST
Timer3 external clock gate input.
RX2(1)
1
I
ST
Asynchronous serial receive data input (EUSARTx module).
DT2(1)
1
O
DIG
Synchronous serial data output (AUSART module); takes priority
over port data.
1
I
ST
Synchronous serial data input (AUSART module); user must
configure as an input.
KBI3
1
I
ST
Interrupt-on-pin change.
TABLE 11-3:
PORTB FUNCTIONS (CONTINUED)
Pin Name
Function
TRIS
Setting
I/O
I/O Type
Description
Legend:
O = Output; I = Input; ANA = Analog Signal; DIG = CMOS Output; ST = Schmitt Trigger Buffer Input;
x
= Don’t care (TRIS bit does not affect port direction or is overridden for this option)
Note
1:
This pin assignment is only available for 28-pin devices (PIC18F2XK80).
2:
This is the default pin assignment for CANRX and CANTX when the CANMX Configuration bit is set.
3:
This is the default pin assignment for T0CKI when the T0CKMX Configuration bit is set.
4:
This is the default pin assignment for T3CKI for 28, 40 and 44-pin devices. This is the alternate pin assignment for
T3CKI for 64-pin devices when T3CKMX is cleared.
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