參數(shù)資料
型號： PIC24FV32KA302-I/SO
廠商： Microchip Technology
文件頁數(shù)： 174/352頁
文件大?。?/td> 0K
描述： MCU 32KB FLASH 2KB RAM 28-SOIC
標準包裝： 27
系列： PIC® XLP™ 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 23
程序存儲器容量： 32KB（11K x 24）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 13x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
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2011-2012 Microchip Technology Inc.
DS39995C-page 255
PIC24FV32KA304 FAMILY
28.0
INSTRUCTION SET SUMMARY
The PIC24F instruction set adds many enhancements
to the previous PIC MCU instruction sets, while
maintaining an easy migration from previous PIC MCU
instruction sets. Most instructions are a single program
memory word. Only three instructions require two
program memory locations.
Each single-word instruction is a 24-bit word divided
into an 8-bit opcode, which specifies the instruction
type and one or more operands, which further specify
the operation of the instruction. The instruction set is
highly orthogonal and is grouped into four basic
categories:
Word or byte-oriented operations
Bit-oriented operations
Literal operations
Control operations
Table 28-1 lists the general symbols used in describing
the instructions. The PIC24F instruction set summary
in Table 28-2 lists all the instructions, along with the
status flags affected by each instruction.
Most word or byte-oriented W register instructions
(including barrel shift instructions) have three
operands:
The first source operand, which is typically a
register ‘Wb’ without any address modifier
The second source operand, which is typically a
register ‘Ws’ with or without an address modifier
The destination of the result, which is typically a
register ‘Wd’ with or without an address modifier
However, word or byte-oriented file register instructions
have two operands:
The file register specified by the value, ‘f’
The destination, which could either be the file
register, ‘f’, or the W0 register, which is denoted
as ‘WREG’
Most
bit-oriented
instructions
(including
simple
rotate/shift instructions) have two operands:
The W register (with or without an address
modifier) or file register (specified by the value of
‘Ws’ or ‘f’)
The bit in the W register or file register (specified
by a literal value or indirectly by the contents of
register ‘Wb’)
The literal instructions that involve data movement may
use some of the following operands:
A literal value to be loaded into a W register or file
register (specified by the value of ‘k’)
The W register or file register where the literal
value is to be loaded (specified by ‘Wb’ or ‘f’)
However, literal instructions that involve arithmetic or
logical operations use some of the following operands:
The first source operand, which is a register ‘Wb’
without any address modifier
The second source operand, which is a literal
value
The destination of the result (only if not the same
as the first source operand), which is typically a
register ‘Wd’ with or without an address modifier
The control instructions may use some of the following
operands:
A program memory address
The mode of the table read and table write
instructions
All instructions are a single word, except for certain
double-word
instructions,
which
were
made
double-word instructions so that all of the required
information is available in these 48 bits. In the second
word, the 8 MSbs are ‘0’s. If this second word is
executed as an instruction (by itself), it will execute as
a NOP.
Most single-word instructions are executed in a single
instruction cycle, unless a conditional test is true or the
Program Counter (PC) is changed as a result of the
instruction. In these cases, the execution takes two
instruction cycles, with the additional instruction
cycle(s) executed as a NOP. Notable exceptions are the
BRA
(unconditional/computed
branch),
indirect
CALL/GOTO
, all table reads and writes, and
RETURN/RETFIE
instructions, which are single-word
instructions but take two or three cycles.
Certain instructions that involve skipping over the
subsequent instruction require either two or three
cycles if the skip is performed, depending on whether
the instruction being skipped is a single-word or
two-word instruction. Moreover, double-word moves
require two cycles. The double-word instructions
execute in two instruction cycles.
Note:
This chapter is a brief summary of the
PIC24F instruction set architecture and is
not intended to be a comprehensive
reference source.
相關PDF資料
PDF描述
PIC24HJ64GP204-I/ML IC PIC MCU FLASH 64K 44-QFN
SFW27R-2STE1 SFW27R-2STE1-FFC/FPC CONN
PIC24F16KA302-I/SP MCU 16KB FLASH 2KB RAM 28-SPDIP
PIC18LF45J11-I/ML IC PIC MCU FLASH 32K 2V 44-QFN
PIC24F32KA302-I/SO MCU 32KB FLASH 2KB RAM 28-SOIC
相關代理商/技術參數(shù)
參數(shù)描述
PIC24FV32KA302T-I/ML 功能描述:16位微控制器 - MCU 32KB 2KBRM 512B EE 16Mp 12b ADC CTMU 5V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT
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PIC24FV32KA304 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:20/28/44/48-Pin, General Purpose, 16-Bit Flash Microcontrollers with XLP Technology
PIC24FV32KA304_1 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:20/28/44/48-Pin, General Purpose, 16-Bit Flash Microcontrollers with XLP Technology
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