參數(shù)資料
型號(hào)： PIC24HJ32GP204-I/PT
廠商： Microchip Technology
文件頁數(shù)： 191/289頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 32K 44TQFP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 160
系列： PIC® 24H
核心處理器： PIC
芯體尺寸： 16-位
速度： 40 MIP
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 35
程序存儲(chǔ)器容量： 32KB（11K x 24）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x10b/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-TQFP
包裝： 托盤
產(chǎn)品目錄頁面： 648 (CN2011-ZH PDF)
配用： DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
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CHAPTER 7 16-BIT TIMER/EVENT COUNTER Q (TMQ)
User’s Manual U17716EJ2V0UD
269
7.6.1
Interval timer mode (TQnMD2 to TQnMD0 bits = 000)
In the interval timer mode, an interrupt request signal (INTTQnCC0) is generated at the interval set by the
TQnCCR0 register if the TQnCTL0.TQnCE bit is set to 1. A PWM waveform with a duty factor of 50% whose half
cycle is equal to the interval can be output from the TOQn0 pin.
The TQnCCR1 to TQnCCR3 registers are not used in the interval timer mode. However, the set value of the
TQnCCR1 to TQnCCR3 registers is transferred to the CCR1 to CCR3 buffer registers and, when the count value of
the 16-bit counter matches the value of the CCR1 to CCR3 buffer registers, compare match interrupt request signals
(INTTQnCC1 to INTTQnCC3) are generated. In addition, a PWM waveform with a duty factor of 50%, which is
inverted when the INTTQ0CC1 to INTTQ0CC3 signals are generated, can be output from the TOQ01 to TOQ03 pins.
The value of the TQnCCR1 to TQnCCR3 registers can be rewritten even while the timer is operating.
Figure 7-8. Interval Timer Configuration
16-bit counter
Output
controller
CCR0 buffer register
TQnCE bit
TQnCCR0 register
Count clock
selection
Clear
Match signal
TOQn0 pin
INTTQnCC0 signal
Remark
n = 0, 1
Figure 7-9. Basic Timing of Operation in Interval Timer Mode
FFFFH
16-bit counter
0000H
TQnCE bit
TQnCCR0 register
TOQn0 pin output
INTTQnCC0 signal
D0
Interval (D0 + 1)
Remark
n = 0, 1
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