參數(shù)資料
型號(hào)： PLL2126X
英文描述： PLL2126X 20MHz ~ 100MHz FSPLL|Data Sheet
中文描述： PLL2126X為20MHz?100MHz的FSPLL |數(shù)據(jù)資料
文件頁數(shù)： 2/10頁
文件大?。?/td> 150K
代理商： PLL2126X
SEC ASIC
50MHz~300MHz FSPLL
ANALOG
PLL2108X
NAME
I/O
TYPE
PIN DESCRIPTION
AVDD12D
DP
Digital power supply
AVSS12D
DG
Digital ground
AVDD12A
AP
Analog power supply
AVSS12A
AG
Analog ground
VABB
AB/DB
Analog / Digital bulk bias
FIN
DI
PLL clock input
FOUT
DO
50MHz~300MHz
clock output
FILTER
AO
The external loop filter cap-
acitor should be connected
between the pin and analog
ground
PWRDN
DI
Power down.
-If PWRDN is high, power
down mode is enabled.
P[5:0]
DI
6bit programmable
pre-divider.
M[7:0]
DI
8bit programmable
main-divider.
S[1:0]
DI
2bit programmable
post-scaler.
CORE PIN DESCRIPTION
CORE CONFIGURATION
2/10
I/O TYPE ABBR.
AI : Analog Input
DI : Digital Input
AO: Analog Output
DO: Digital Output
AP : Analog Power
AG: Analog Ground
AB: Analog Sub Bias
DP : Digital Power
DG: Digital Ground
DB: Digital Sub Bias
BD: Bidirectional Port
FILTER
FIN
PWRDN
M[7:0]
P[0]
M[5]
M[4]
M[3]
M[2]
M[1]
M[0]
M[7]
M[6]
S[1]
S[0]
S[1:0]
FOUT
pll2108x
P[5]
P[4]
P[3]
P[2]
P[5:0]
相關(guān)PDF資料
PDF描述
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PLL2128X PLL2128X 20MHz ~ 100MHz FSPLL|Data Sheet
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PLLCORE170 12-Bit Rail-to-Rail Micropower DACs in SO-8; Package: PDIP; No of Pins: 8; Temperature Range: -40°C to +85°C
PLLCORE60 12-Bit Rail-to-Rail Micropower DACs in SO-8; Package: PDIP; No of Pins: 8; Temperature Range: 0°C to +70°C
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