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參數(shù)資料
| 型號： | PSD301R |
| 英文描述： | Field Programmable Microcontroller Peripherals(可編程邏輯,無SRAM,19個可編程I/O,通用PLD有12個輸入) |
| 中文描述： | 現(xiàn)場可編程微控制器外圍設備（可編程邏輯，無的SRAM，19余個可編程輸入/輸出，通用PLD的有12個輸入） |
| 文件頁數(shù)： | 37/127頁 |
| 文件大?。?/td> | 682K |
| 代理商： | PSD301R |
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PSD3XX Famly
2-37
-70
-90
-12
-15
-20
CMiser
On =
Add
Symbol
Parameter
Unit
Min Max Min Max Min Max Min Max Min Max
T17
Write Data Hold Time
5
5
5
10
15
0
ns
T18
Port to Data Out Valid
Propagation Delay
25
28
30
35
45
0
ns
T19
Port Input Hold Time
0
0
0
0
0
0
ns
T20
Trailing Edge of Write
to Port Output Valid
30
35
40
50
60
0
ns
T21
ADi or Control to CSOi
Valid
6
20
6
25
6
30
6
35
5
45
10
ns
T22
ADi or Control to CSOi
Invalid
5
20
5
25
5
30
4
35
4
45
10
ns
Track Mode Address
Propagation Delay:
CSADOUT1 Already True
22
22
22
22
28
0
ns
T23
Latched Address Outputs,
Port A
22
22
22
22
28
0
ns
Track Mode Address
Propagation Delay:
CSADOUT1 Becomes
True During ALE or AS
T23A
33
33
33
40
50
10
ns
Track Mode Trailing Edge
of ALE or AS to Address
High-Z
T24
30
32
32
35
40
0
ns
Track Mode Read
Propagation Delay
T25
27
29
29
29
35
0
ns
T26
Track Mode Read
Hold Time
5
29
11
29
11
29
11
29
11
35
0
ns
Track Mode Write Cycle,
Data Propagation Delay
T27
18
20
20
20
30
0
ns
Track Mode Write
Cycle, Write to Data
Propagation Delay
T28
6
30
8
30
8
30
9
40
9
55
0
ns
Hold Time of Port A
Valid During Write
CSOi Trailing Edge
T29
2
2
2
2
2
0
ns
CSI Active to CSOi
Active (PSD3X1)
8
37
9
40
9
45
9
45
8
60
0
ns
T30
CSI Active to CSOi
Active (PSD3X2/3X3/3X4R)
8
37
9
40
9
45
9
50
8
60
0
ns
CSI Inactive to CSOi
Inactive
T31
8
37
9
40
9
45
9
45
8
60
0
ns
T32
Direct PAD Input as
Hold Time
0
0
0
0
0
0
ns
AC Characteristics – PSD3XX Versions (5V ±10%)
(Cont.)
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PDF描述 |
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