參數(shù)資料
型號(hào)： PSD313L
英文描述： Field Programmable Microcontroller Peripherals(可編程邏輯,16K位SRAM,19個(gè)可編程I/O,通用PLD有16個(gè)輸入)
中文描述： 現(xiàn)場(chǎng)可編程微控制器外圍設(shè)備（可編程邏輯，16K的位的SRAM，19余個(gè)可編程輸入/輸出，通用PLD的有16個(gè)輸入）
文件頁(yè)數(shù)： 124/127頁(yè)
文件大小： 682K
代理商： PSD313L
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2-125
J
Single Chip Programmable Peripheral for Microcontroller-based Applications
J
3.0 to 5.5 Volt Operation
J
19 Individually Configurable I/O pins that can be used as:
— Microcontroller I/O port expansion
— Programmable Address Decoder (PAD) I/O
— Latched address output
— Open drain or CMOS
J
Two Programmable Arrays (PAD A & PAD B)
— Total of 40 Product Terms and up to 16 Inputs and 24 Outputs
— Direct Address Decoding up to 1 Meg address space and up to 16 Meg with paging
— Logic replacement
J
“No Glue” Microcontroller Chip-Set
— Built-in address latches for multiplexed address/data bus
— Non-multiplexed address/data bus mode
— 8-bit data bus width
— ALE polarity programmable
— Selectable modes for read and write control bus as RD/WR, R/W/E, or R/W/DS
— PSEN pin for 8051 users
J
Built-In Page Logic
— To Expand the Address Space of Microcontrollers with Limited Address
Space Capabilities
— Up to 16 pages
J
2M bit of UV EPROM
— Configurable as 256K x 8
— Divides into 8 equal mappable blocks for optimized mapping
— Block resolution is 32K x 8
— 300 ns EPROM access time, including input latches and PAD address decoding.
J
Address/Data Track Mode
— Enables easy Interface to Shared Resources (e.g., Mail Box SRAM) with
other Microcontrollers or a Host Processor
J
CMiser-Bit
— Programmable option to further reduce power consumption
J
Built-In Security
— Locks the PSD314RL and PAD Decoding Configuration
J
Available in a Choice of Packages
— 44 Pin PLDCC, CLDCC and TQFP
J
Simple Menu-Driven Software: Configure the PSD314RL on an IBM PC
J
Pin and Functionally Compatible with the PSD3XX and PSD3XXL Series
Key Features
Programmable Peripheral
PSD314RL
3-Volt Single-Chip Microcontroller Peripheral
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PDF描述
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PSD3A011-01 Interface IC
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