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參數(shù)資料
| 型號： | PSD511B1 |
| 英文描述： | PSD5XX/ZPSD5XX FAMILY FIELD-PROGRAMMABLE MICROCONTROLLER PERIPHERALS |
| 中文描述： | PSD5XX/ZPSD5XX家庭領(lǐng)域，可編程微控制器外設(shè) |
| 文件頁數(shù)： | 86/153頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | PSD511B1 |
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PSD5XX Famly
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9.6.2.1 Gobal Command Register
This is used to specify the operation mode of the Counter/Timer and to start or stop the
Counter/Timer. Therefore during the initialization of the Counter/Timer registers, the Global
Command Register should always be configured last.
Counter/Timer
Registers
(Cont.)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
*
*
*
*
Watch
Dog
Global
Mode
Counter
Start
Scale
NOTE:
*
= Not used.
At RESET all bits come up as 0’s.
Watch Dog Bit:
When this bit is
0: Watch Dog mode is NOT selected.
1: Watch Dog Counter/Timer (Counter 2) is active. This bit can be
turned off by RESET only.
NOTE:
Whenever this bit is set to 1, the COUNTER START bit should
also be set to 1. Otherwise the Counter/Timer will always be off,
i.e., once this bit is set, access to Counter 2 Registers and the Global
Command Registers are blocked.
Global Mode Bit:
When this bit is set to a
0: All Timers/Counters are set to Waveform or Pulse Mode.
1: All Timers/Counters are set to operate in Event Counter or Time
Capture Mode.
NOTE:
Further selection of modes is done in individual CMD registers.
Counter Start Bit:
When this bit is set to
0: ALL CTUs are disabled and can be re-initialized.
1: ALL CTUs are enabled.
Scale Bit:
When this bit is set to
0: The clock to all Counter/Timers is divided by 1.
1: The clock to all Counter/Timers is divided by 8.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PSD512B0 | 500V 100kRad Hi-Rel Single N-Channel SEE Hardened MOSFET in a TO-205AF package; A IRHF7430SE with Standard Packaging |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PSD511B1-12JI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
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| PSD511B1-12U | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
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