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參數(shù)資料
| 型號： | PSD512B1 |
| 英文描述： | -100V 100kRad Hi-Rel Single P-Channel TID Hardened MOSFET in a SMD-2 package; Similar to IRHNA597160 with optional Total Dose Rating of 300kRads |
| 中文描述： | PSD5XX/ZPSD5XX家庭領(lǐng)域，可編程微控制器外設(shè) |
| 文件頁數(shù)： | 130/153頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | PSD512B1 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁當(dāng)前第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁
PSD5XX Famly
127
-20
-25
ZPLD_TURBO
OFF
*
Symbol
Parameter
Conditions
Min
Max
Min
Max
Unit
t
IVIV
Interrupt Request Input to
Interrupt Output
(Note 3)
70
120
0
ns
t
RXIX
Read Vector to Interrupt
Request Clear
60
100
0
ns
t
ILIL
Interrupt Request Minimum
Pulse Width
40
45
0
ns
t
RLQV
RD to Data Valid Interrupt
Controller
(Note 1)
50
90
0
ns
-20
-25
ZPLD_TURBO
OFF
*
Symbol
Parameter
Conditions
Min
Max
Min
Max
Unit
f
MAX
t
CHCL
t
CLCH
t
CHPV
t
CHPV1
Maximum Frequency
20.00
12.50
0
MHz
Clock High Time
Clock Low Time
Clock to Output Delay
16
16
22
22
0
0
0
ns
ns
ns
50
55
Clock to Watchdog Output Delay
90
100
Add 20
ns
t
LVCH
Input Setup Time Relative
to Rising Level Clock
Add 20
(Note 2)
Any Input
45
60
ns
t
MIN
Minimum Clock Period
1/f
MAX
50
80
0
ns
NOTES:
1. Read to Data Valid of the Interrupt Request Latch and Interrupt Priority Status. RD timing has the same timing as PSEN, DS, LDS,
UDS signals.
2. For inputs which use PPLD only.
3. This timing is only valid when read to the interrupt request latch and priority status latch are not valid.
*
If ZPLD_TURBO is off and the ZPLD is operating above 15 MHz, there is no need to add 20 ns to the timing parameters.
Counter/Timer Timng
(3.0 V ± 10%)
Interrupt Timng
(3.0 V ± 10%)
AC/DC Parameters – ZPLDTimng Parameters
(ZPSD5XXV Versions)
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PDF描述 |
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參數(shù)描述 |
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| PSD512B1-12JI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
| PSD512B1-12LI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
| PSD512B1-12U | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
| PSD512B1-12UI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Peripheral |
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