參數(shù)資料
型號： PXF4336
廠商： INFINEON TECHNOLOGIES AG
英文描述： ABM Premium ATM Buf fer Manager
中文描述： 反導(dǎo)高級經(jīng)理自動(dòng)柜員機(jī)緩沖帶的FER
文件頁數(shù)： 258/425頁
文件大?。?/td> 6279K
代理商： PXF4336
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ABM-P
PXF 4336 V1.1
Register Description
Data Sheet
258
2001-12-17
7.2.12
Queue Configuration Table Transfer Registers
Internal Table 4: Queue Configuration Table Transfer Registers QCT0..6
Queue Configuration Table Transfer Registers are used to access the internal Queue
Configuration Table (QCT) containing 2*8192 entries. The lower 8K entries control the
upstream core queues and the upper 8K entries control the downstream core queues.
Table 7-10
shows an overview of the registers involved. Some fields are not used for
entry 0 (common real time bypass)
QCT0...QCT6 are the transfer registers for one 112 bit QCT table entry. The core
selection and queue number representing the table entry which needs to be read or
written must be written to the Word Address Register (
WAR
). The dedicated QCT table
entry is read into the QCT0..QCT6 registers or modified by the QCT0..QCT6 register
values with a write mechanism. The associated Mask Registers MASK0..MASK6 allow
a bit-wise Write operation (0 - unmasked, 1 - masked). In case of Read operation, the
dedicated QCT0..QCT6 register bit will be overwritten by the respective QCT table entry
bit value. In case of Write operation, the dedicated QCT0..QCT6 register bit will modify
the respective QCT table entry bit value.
Note: It is recommended not to Write to bit fields (111:64) and (15:0) of the QCT table
entries; i.e. registers MASK0, MASK6, MASK5, MASK4 and MASK3 should
always be programmed with FFFF
H
.
The 13 LSBs (= Bit 12..0) of the WAR register select the queue-specific entry that will be
accessed and bit ’CoreSel’ the
ABM-P
core.
The Read or Write process is controlled by the Memory Address Register (
MAR
). The 5
LSBs (= Bit 4..0) of the MAR select the memory/table that will be accessed; to select the
QCT table, bit field MAR(4:0) must be set to 2. Bit 5 of MAR starts the transfer and is
automatically cleared after execution.
Table 7-10
Registers for Queue Configuration Table Access
111
0
QCT RAM entry
RAM
select:
15
MAR=02
H
Queue
select:
15
WAR
(0..16383
D
)
15
0 15
0 15
0 15
0 15
0 15
0 15
0
0
QCT6
QCT5
QCT4
QCT3
QCT2
QCT1
QCT0
15
MASK6
=FFFF
H
0 15
0 15
0 15
0 15
0 15
0 15
0
0
MASK5
=FFFF
H
MASK4
=FFFF
H
MASK3
=FFFF
H
MASK2
MASK1
MASK0
=FFFF
H
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PDF描述
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