- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄361238 > Q67101-H5190 (SIEMENS AG) SRC-Scan Rate Converter SDA9255 PDF資料下載
參數(shù)資料
| 型號(hào)： | Q67101-H5190 |
| 廠商： | SIEMENS AG |
| 英文描述： | SRC-Scan Rate Converter SDA9255 |
| 中文描述： | 鋼骨混凝土掃描頻率轉(zhuǎn)換器SDA9255 |
| 文件頁(yè)數(shù)： | 16/272頁(yè) |
| 文件大?。?/td> | 4055K |
| 代理商： | Q67101-H5190 |
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SAB 82532/SAF 82532
Introduction
Semiconductor Group
16
07.96
24
23
56
55
IE0
IE1
I/O
I
Interrupt Enable 0, 1
The function depends on the selected
cascading mode:
Slave mode:
IE0 and IE1 are inputs.
Interrupt acknowledge is accepted if an
interrupt signal has been generated and
the slave address provided via IE0, IE1
corresponds to the programmed value
(IPC register).
If not used, IE0 and IE1 should be tied to
GND and the slave address should be set
to ‘0’ (e.g. single device application).
Daisy Chaining mode:
IE0 is output, IE1
is input.
Normally, IE1 is connected to the IE0 pin
of devices with higher priority. If not used,
IE1 has to be fixed to ‘1’.
If IE1 is reset (‘0’)
– the IE0 output is reset immediately,
– an active INT signal will be prohibited
or aborted.
As long as INTA input is inactive, IE1 = ‘1’
enables INT signal generation. If INT goes
active, pin IE0 immediately is set to ‘0’.
Interrupt acknowledge is accepted if the
Interrupt Enable input IE1 is active during
the following INTA cycle. During this
cycle, and additionally ‘till the end of the
second INTA cycle in Siemens/Intel bus
mode, triggering of INT signal generation
is prohibited, i.e. no interrupt will be
generated while (another) device is under
service. This is valid even for devices with
higher priority.
Pin IE0 returns to active state (logical ‘1’)
when INT is reset and IE1 input is high.
1.3
Pin Definitions and Functions
(cont’d)
Pin No.
Symbol
Input (I)
Output (O)
Function
P-LCC-68
P-MQFP-80
相關(guān)PDF資料 |
PDF描述 |
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