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參數(shù)資料
| 型號： | Q67101-H6773 |
| 廠商： | SIEMENS AG |
| 英文描述： | Replaced by UCC2897A : Current Mode Active Clamp PWM Controller 20-TSSOP -40 to 105 |
| 中文描述： | 聯(lián)合音頻解碼器，編碼器-多模 |
| 文件頁數(shù)： | 17/272頁 |
| 文件大?。?/td> | 4055K |
| 代理商： | Q67101-H6773 |
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SAB 82532/SAF 82532
Introduction
Semiconductor Group
17
07.96
34
33
70
69
DRTA
DRTB
O
DMA Request Transmitter
(channel A/channel B)
The transmitter of ESCC2 requests a
DMA transfer by activating this line. The
request remains active as long as the
respective Transmit FIFO requires data
transfers.
The amount of data bytes to be
transferred from the system memory to
the ESCC2 (= byte count) must be written
first to the XBCH, XBCL registers.
Always blocks of data (n
×
32 bytes +
REST,
n = 0, 1, …) are transferred ‘till the Byte
Count is reached.
DRTn is deactivated with the beginning of
the last write cycle.
32
31
68
67
DRRA
DRRB
O
DMA Request Receiver
(channel A/channel B)
The receiver of ESCC2 requests a DMA
transfer by activating this line. The
request remains active as long as the
corresponding Receive FIFO requires
data transfers, thus always blocks of data
are transferred.
DRRn is deactivated immediately
following the falling edge of the last read
cycle.
1.3
Pin Definitions and Functions
(cont’d)
Pin No.
Symbol
Input (I)
Output (O)
Function
P-LCC-68
P-MQFP-80
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