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參數資料
| 型號： | Q67101-H6789 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數： | 11/272頁 |
| 文件大小： | 4055K |
| 代理商： | Q67101-H6789 |
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SAB 82532/SAF 82532
Introduction
Semiconductor Group
11
07.96
1.3
Pin Definitions and Functions
Pin No.
Symbol
Input (I)
Output (O)
Function
P-LCC-68
P-MQFP-80
2 ... 8
31 … 37
A0 ... A6
I
Address Bus
These inputs interface with seven bits of
the system’s address bus to select one of
the internal registers for read or write.
60 ... 45
19 … 4
D0 ... D15 I/O
Data Bus
Bi-directional three-state data lines which
interface with the system’s data bus. Their
configuration is controlled by the level of
pin WIDTH:
– 8-bit mode (WIDTH = 0): D0 ... D7 are
active.
D8 ... D15 are in high impedance and
have to be connected to
V
DD
or
V
SS
.
– 16-bit mode (WIDTH = 1): D0 ... D15
are active. In case of byte transfers, the
active half of the bus is determined by
A0 and BHE/BLE and the selected bus
interface mode (via ALE). The unused
half is in high impedance. For detailed
information, refer to
chapter 3.1
.
9
38
ALE
I
Address Latch Enable
The level at this pin defines the bus
interface mode:
Fixed to
V
SS
:
Demultiplexed
Siemens/Intel bus interface
Fixed to ‘1’:
Demultiplexed Motorola bus
interface
Switching:
Multiplexed Siemens/Intel
bus interface
The address information provided on lines
A0 ... A6 is internally latched with the
falling edge of ALE. This function allows
the ESCC2 to be directly connected to a
multiplexed address/data bus. In this
case, pins A0 ... A6 must be externally
connected to the Data Bus pins (e.g.
D0 … D6 for 8-bit CPUs).
Note: All unused input pins have to be connected to a defined level.
相關PDF資料 |
PDF描述 |
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參數描述 |
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