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參數資料
| 型號： | Q67101-H6791 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數： | 124/272頁 |
| 文件大小： | 4055K |
| 代理商： | Q67101-H6791 |
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SAB 82532/SAF 82532
Detailed Register Description
Semiconductor Group
124
07.96
Timer Register (TIMR)
Access: read/write
address: ch-A: 23
H
ch-B: 63
H
7
0
TIMR
CTN
VALUE
VALUE …
(5 bits) Sets the time period
t
1
as follows:
t
1
= k
×
(VALUE + 1)
×
TCP
where
– k is the timer resolution factor which is either 32 768 or 512
clock cycles dependent on the programming of TRS bit in
MODE.
– TCP is the clock period of transmit data (CCR0:MCE = ‘0’) or
master clock (CCR0:MCE = ‘1’).
(3 bits) Interpreted differently depending on the selected timer
mode (bit TMD in MODE).
Internal timer mode (MODE:TMD = ‘1’) – Retry Counter (in
HDLC known as N2)
CNT indicates the number of S-commands (max. 6) which are
transmitted autonomously by the ESCC2 after expiration of
time period
t
1
, in case an I-frame is not acknowledged by the
opposite station.
If CNT is set to 7, the number of S-commands is unlimited.
External timer mode (MODE:TMD = ‘0’)
CNT plus VALUE determine the time period
t
2
after which a
timer interrupt will be generated. The time period
t
2
is
t
2
= 32
×
k
×
CNT
×
TCP +
t
1
.
If CNT is set to 7, a timer interrupt is periodically generated after
the expiration of
t
1
.
CNT …
HDLC Mode
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PDF描述 |
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