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參數資料
| 型號： | S3S12HZ256J3CAA |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 25 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, QFP-80 |
| 文件頁數： | 518/692頁 |
| 文件大?。?/td> | 3799K |
| 代理商： | S3S12HZ256J3CAA |
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Chapter 19 Debug Module (DBGV1)
MC9S12HZ256 Data Sheet, Rev. 2.05
Freescale Semiconductor
565
19.4.3.2
Breakpoint Based on Comparator C
A breakpoint request to the CPU can be created if BKCEN in DBGC2 is set. Breakpoints based on a
successful comparator C match can be accomplished regardless of the mode of operation for comparator
A or B, and do not affect the status of the ARM bit. TAGC in DBGC2 is used to select either tagged or
forced breakpoint requests for comparator C. Breakpoints based on comparator C are disabled in LOOP1
mode.
NOTE
Because breakpoints cannot be disabled when the DBG is armed, one must
be careful to avoid an “innite breakpoint loop” when using tagged-type C
breakpoints while the DBG is armed. If BDM breakpoints are selected,
executing a TRACE1 instruction before the GO instruction is the
recommended way to avoid re-triggering a breakpoint if one does not wish
to de-arm the DBG. If SWI breakpoints are selected, disarming the DBG in
the SWI interrupt service routine is the recommended way to avoid
re-triggering a breakpoint.
19.5
Resets
The DBG module is disabled after reset.
The DBG module cannot cause a MCU reset.
19.6
Interrupts
The DBG contains one interrupt source. If a breakpoint is requested and BDM in DBGC2 is cleared, an
SWI interrupt will be generated.
Table 19-26. Breakpoint Setup
BEGIN
TRGSEL
DBGBRK
Type of Debug Run
0
Fill trace buffer until trigger address
(no CPU breakpoint — keep running)
0
1
Fill trace buffer until trigger address, then a forced breakpoint
request occurs
0
1
0
Fill trace buffer until trigger opcode is about to execute
(no CPU breakpoint — keep running)
0
1
Fill trace buffer until trigger opcode about to execute, then a
tagged breakpoint request occurs
1
0
Start trace buffer at trigger address
(no CPU breakpoint — keep running)
1
0
1
Start trace buffer at trigger address, a forced breakpoint
request occurs when trace buffer is full
1
0
Start trace buffer at trigger opcode
(no CPU breakpoint — keep running)
1
Start trace buffer at trigger opcode, a forced breakpoint request
occurs when trace buffer is full
相關PDF資料 |
PDF描述 |
|---|---|
| S9S12HZ256J3CAL | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP112 |
| MC56F8025VLD | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP44 |
| MC56F8025MLD | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP44 |
| MC56F8155VFGE | 4-BIT, 120 MHz, OTHER DSP, PQFP128 |
| MC56F8355VFGE | 4-BIT, 120 MHz, OTHER DSP, PQFP128 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| S3S12HZ256J3CAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers |
| S3S12HZ256J3MAA | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers |
| S3S12HZ256J3MAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers |
| S3S12HZ256J3VAA | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers |
| S3S12HZ256J3VAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers |
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