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參數(shù)資料
| 型號(hào)： | S80C32-L16SHXXX |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 16 MHz, MICROCONTROLLER, PQCC44 |
| 封裝： | PLASTIC, LCC-44 |
| 文件頁數(shù)： | 279/313頁 |
| 文件大?。?/td> | 4988K |
| 代理商： | S80C32-L16SHXXX |
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32000D–04/2011
AVR32
The addresses of the interrupt routines are calculated by adding the address on the autovector
offset bus to the value of the Exception Vector Base Address (EVBA). The INT0, INT1, INT2,
INT3, and NMI signals indicate the priority of the pending interrupt. INT0 has the lowest priority,
and NMI the highest priority of the interrupts. Implementations may require that EVBA is aligned
in an IMPLEMENTATION DEFINED way in order to support autovectoring.
8.3.1
Description of events in AVR32A
8.3.1.1
Reset Exception
The Reset exception is generated when the reset input line to the CPU is asserted. The Reset
exception can not be masked by any bit. The Reset exception resets all synchronous elements
and registers in the CPU pipeline to their default value, and starts execution of instructions at
address 0x8000_0000.
SR = reset_value_of_SREG;
PC = 0x8000_0000;
All other system registers are reset to their reset value, which may or may not be defined. Refer
to the Programming Model chapter for details.
8.3.1.2
OCD Stop CPU Exception
The OCD Stop CPU exception is generated when the OCD Stop CPU input line to the CPU is
asserted. The OCD Stop CPU exception can not be masked by any bit. This exception is identi-
cal to a non-maskable, high priority breakpoint. Any subsequent operation is controlled by the
OCD hardware. The OCD hardware will take control over the CPU and start to feed instructions
directly into the pipeline.
RSR_DBG = SR;
RAR_DBG = PC;
SR[M2:M0] = B’110;
SR[R] = 0;
SR[J] = 0;
SR[D] = 1;
SR[DM] = 1;
SR[EM] = 1;
SR[GM] = 1;
相關(guān)PDF資料 |
PDF描述 |
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| MC908QC16CDTE | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| S80C42 | 制造商:Intel 功能描述: |
| S80C51 WAF | 制造商:Intel 功能描述: |
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| S80C51-16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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