參數(shù)資料
型號(hào): S908QC16CDRER
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO28
封裝: 4.40 MM, 1.20 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, MO-153AE, TSSOP-28
文件頁數(shù): 19/274頁
文件大?。?/td> 3183K
代理商: S908QC16CDRER
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Port D
MC68HC908QC16 MC68HC908QC8 MC68HC908QC4 Data Sheet, Rev. 5
Freescale Semiconductor
115
PTD[7:0] — Port D Data Bits
These read/write bits are software programmable. Data direction of each port D pin is under the control
of the corresponding bit in data direction register D. Reset has no effect on port D data.
11.6.2 Data Direction Register D
Data direction register D (DDRD) determines whether each port D pin is an input or an output. Writing a
1 to a DDRD bit enables the output buffer for the corresponding port D pin; a 0 disables the output buffer.
DDRD[7:0] — Data Direction Register D Bits
These read/write bits control port D data direction. Reset clears DDRD[7:0], configuring all port D pins
as inputs.
1 = Corresponding port D pin configured as output
0 = Corresponding port D pin configured as input
NOTE
Avoid glitches on port D pins by writing to the port D data register before
changing data direction register D bits from 0 to 1. Figure 11-15 shows the
port D I/O logic.
Figure 11-15. Port D I/O Circuit
When DDRDx is a 1, reading address $0003 reads the PTDx data latch. When DDRDx is a 0, reading
address $0003 reads the voltage level on the pin. The data latch can always be written, regardless of the
state of its data direction bit.
Bit 7
6
5
4
3
2
1
Bit 0
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
0
0000000
Figure 11-14. Data Direction Register D (DDRD)
READ DDRD ($0007)
WRITE DDRD ($0007)
RESET
WRITE PTD ($0003)
READ PTD ($0003)
PTDx
DDRDx
PTDx
INTERNAL
D
AT
A
B
US
PULLUP
PTDPUEx
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PDF描述
MC908QC16CDRE 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO28
MC908QC16CDTE 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16
S912XDP512F0VPV 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
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