參數(shù)資料
型號(hào)： SAA7109
廠商： NXP Semiconductors N.V.
元件分類： Codec
英文描述： PC-CODEC
中文描述： PC的編解碼器
文件頁(yè)數(shù)： 131/202頁(yè)
文件大小： 983K
代理商： SAA7109
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2004 Mar 16
131
Philips Semiconductors
Product specification
PC-CODEC
SAA7108E; SAA7109E
Table 95
Subaddress 62H
Table 96
Subaddresses 63H to 66H (four bytes to program subcarrier frequency)
Note
1.
Examples:
a) NTSC M: f
fsc
= 227.5, f
llc
= 1716
→
FSC = 569408543 (21F07C1FH).
b) PAL B/G: f
fsc
= 283.7516, f
llc
= 1728
→
FSC = 705268427 (2A098ACBH).
Table 97
Subaddresses 67H to 6AH
Table 98
Subaddresses 6CH and 6DH
DATA BYTE
DESCRIPTION
CONDITIONS
REMARKS
BSTA
amplitude of colour burst;
input representation in
accordance with
“ITU-R BT.601”
white-to-black = 92.5 IRE;
burst = 40 IRE; NTSC encoding
BSTA = 0 to 2.02
×
nominal
white-to-black = 92.5 IRE;
burst = 40 IRE; PAL encoding
BSTA = 0 to 2.82
×
nominal
white-to-black = 100 IRE;
burst = 43 IRE; NTSC encoding
BSTA = 0 to 1.90
×
nominal
white-to-black = 100 IRE;
burst = 43 IRE; PAL encoding
BSTA = 0 to 3.02
×
nominal
recommended value:
BSTA = 63 (3FH)
recommended value:
BSTA = 45 (2DH)
recommended value:
BSTA = 67 (43H)
recommended value:
BSTA = 47 (2FH); default after
reset
DATA BYTE
DESCRIPTION
CONDITIONS
REMARKS
FSC0 to
FSC3
f
fsc
= subcarrier frequency
(in multiples of line
frequency); f
llc
= clock
frequency (in multiples of
line frequency)
; note 1
FSC3 = most significant byte;
FSC0 = least significant byte
DATA BYTE
DESCRIPTION
REMARKS
L21O0
L21O1
L21E0
L21E1
first byte of captioning data, odd field
second byte of captioning data, odd field
first byte of extended data, even field
second byte of extended data, even field
LSBs of the respective bytes are encoded
immediately after run-in and framing code, the
MSBs of the respective bytes have to carry the
parity bit, in accordance with the definition of
line 21 encoding format.
DATA BYTE
DESCRIPTION
HTRIG
sets the horizontal trigger phase related to chip-internal horizontal input
values above 1715 (FISE = 1) or 1727 (FISE = 0) are not allowed; increasing HTRIG decreases
delays of all internally generated timing signals; the default value is 0
FSC
round
f
llc
f
2
32
×
=
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