t 24 CC 10 + t F – TCL - 10 + t F – ns ALE rising edg" />
參數(shù)資料
型號(hào)： SAF-C161S-LM 3V AA
廠商： Infineon Technologies
文件頁數(shù)： 62/75頁
文件大小： 0K
描述： IC MCU 16BIT ROM/LESS MQFP-80-7
標(biāo)準(zhǔn)包裝： 1
系列： C16xx
核心處理器： C166
芯體尺寸： 16-位
速度： 20MHz
連通性： EBI/EMI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 63
程序存儲(chǔ)器類型： ROMless
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 剪切帶 (CT)
其它名稱： SAF-C161S-LM3VAACT
SAF-C161S-LM3VAACT-ND
SAF-C161S-LM3VAAINCT
C161S
Timing Characteristics
Data Sheet
61
V1.0, 2003-11
Data hold after WR
t
24
CC 10 +
t
F
–
TCL - 10
+
t
F
–
ns
ALE rising edge after RD,
WR
t
26
CC -10 +
t
F
–
-10 +
t
F
–
ns
Address hold after WR
2)
t
28
CC 0 +
t
F
–
0 +
t
F
–
ns
ALE falling edge to CS
3)
t
38
CC -4 -
t
A
10 -
t
A
-4 -
t
A
10 -
t
A
ns
CS low to Valid Data In
t
39
SR –
40 +
t
C + 2tA
–
3TCL - 20
+
t
C + 2tA
ns
CS hold after RD, WR
t
41
CC 6 +
t
F
–
TCL - 14
+
t
F
–
ns
ALE falling edge to
RdCS, WrCS (with
RW-delay)
t
42
CC 16 +
t
A
–
TCL - 4
+
t
A
–
ns
ALE falling edge to
RdCS, WrCS (no
RW-delay)
t
43
CC -4 +
t
A
–
-4
+
t
A
–
ns
RdCS to Valid Data In
(with RW-delay)
t
46
SR –
16 +
t
C
–
2TCL - 24
+
t
C
ns
RdCS to Valid Data In
(no RW-delay)
t
47
SR –
36 +
t
C
–
3TCL - 24
+
t
C
ns
RdCS, WrCS Low Time
(with RW-delay)
t
48
CC 30 +
t
C
–
2TCL - 10
+
t
C
–
ns
RdCS, WrCS Low Time
(no RW-delay)
t
49
CC 50 +
t
C
–
3TCL - 10
+
t
C
–
ns
Data valid to WrCS
t
50
CC 26 +
t
C
–
2TCL - 14
+
t
C
–
ns
Data hold after RdCS
t
51
SR 0
–
0
–
ns
Data float after RdCS
(with RW-delay)
t
53
SR –
20 +
t
F
–
2TCL - 20
+ 2
t
A + tF
ns
Table 18
Demultiplexed Bus (Standard Supply Voltage Range) (cont’d)
(Operating Conditions apply)
ALE cycle time = 4 TCL + 2
t
A + tC + tF (80 ns at 25 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 25 MHz
Variable CPU Clock
1 / 2TCL = 1 to 25 MHz
Unit
Min.
Max.
Min.
Max.
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參數(shù)描述
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