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參數(shù)資料
| 型號： | SAK-C509-LM |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, MQFP-100 |
| 文件頁數(shù)： | 50/74頁 |
| 文件大?。?/td> | 1607K |
| 代理商： | SAK-C509-LM |
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Semiconductor Group
53
09.96
C509-L
The A/D converter provides the following features:
– 15 multiplexed input channels, which can also be used as digital inputs (port 7, port 8)
– 10-bit resolution
– Single or continuous conversion mode
– Internal or external start-of-conversion trigger capability
– Programmable conversion and sample clock
– Interrupt request generation after each conversion
– Using successive approximation conversion technique via a capacitor array
– Built-in hidden calibration of offset and linearity errors
The A/D converter uses basically three clock signals for operation : the input clock fIN (=1/tIN), the
conversion clock fADC (=1/tADC) and the sample clock fSC (=1/tSC). All clock signals are derived
from the C509-L system clock fOSC which is applied at the XTAL pins. The input clock fIN is equal
to fOSC while the conversion clock and the sample clock must be adapted. The conversion clock is
limited to a maximum frequency of 2 MHz. The table in figure 28 defines the divider ratio for the
conversion and sample clock of each combination of the prescaler bits.
Figure 28
A/D Converter Clock Selection
Conversion Clock
fADC
Sample Clock
fSC
ADCL1 ADCL0
fADC
ADST1 ADST0
0
ADST1 ADST0
0
1
ADST1 ADST0
1
0
ADST1 ADST0
1
0
fIN / 4
fIN / 8
fIN / 16
fIN / 32
fIN / 64
0
1
fIN / 8
fIN / 16
fIN / 32
fIN / 64
fIN / 128
1
0
fIN / 16
fIN / 32
fIN / 64
fIN / 128
fIN / 256
1
fIN / 32
fIN / 64
fIN / 128
fIN / 256
fIN / 512
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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