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參數(shù)資料
| 型號： | sda 9205 |
| 廠商： | SIEMENS AG |
| 英文描述： | Triple 8-Bit Analog-to-Digital-Converter(三倍8位A/D轉換器) |
| 中文描述： | 三8位模擬到數(shù)字轉換器（三倍8位的A / D轉換器） |
| 文件頁數(shù)： | 11/31頁 |
| 文件大?。?/td> | 560K |
| 代理商： | SDA 9205 |
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SDA 9205-2
Semiconductor Group
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The digital output data are synchronized by the FSY signal. The first high of FSY defines the first
output format byte and is synchronized to CLK. In case of asynchronism the first (in formats 8:1:1,
4:1:1 the first and the second) output format byte after FSY had gone high does not contain valid
data. Timing of FSY, CLK and output data is shown in
figure 4
with output format 4:1:1.
Figure 4
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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