參數(shù)資料
型號: ST72344S4T6
廠商: STMICROELECTRONICS
元件分類: 微控制器/微處理器
英文描述: MICROCONTROLLER, PQFP44
封裝: 10 X 10 MM, ROHS COMPLIANT, TQFP-32
文件頁數(shù): 41/246頁
文件大小: 2016K
代理商: ST72344S4T6
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ST72344xx, ST72345xx
On-chip peripherals
Note:
Resetting and setting the TE bit causes the data in the TDR register to be lost. Therefore the
best time to toggle the TE bit is when the TDRE bit is set, that is, before writing the next byte
in the SCIDR.
Receiver
The SCI can receive data words of either 8 or 9 bits. When the M bit is set, word length is 9
bits and the MSB is stored in the R8 bit in the SCICR1 register.
Character reception
During a SCI reception, data shifts in least significant bit first through the RDI pin. In
this mode, the SCIDR register consists or a buffer (RDR) between the internal bus and
the received shift register (see Figure 63).
Procedure:
Select the M bit to define the word length.
Select the desired baud rate using the SCIBRR and the SCIERPR registers.
Set the RE bit, this enables the receiver which begins searching for a start bit.
When a character is received:
The RDRF bit is set. It indicates that the content of the shift register is transferred
to the RDR.
An interrupt is generated if the RIE bit is set and the I bit is cleared in the CCR
register.
The error flags can be set if a frame error, noise or an overrun error has been
detected during reception.
Clearing the RDRF bit is performed by the following software sequence done by:
a)
An access to the SCISR register
b)
A read to the SCIDR register.
The RDRF bit must be cleared before the end of the reception of the next character to
avoid an overrun error.
Break character
When a break character is received, the SCI handles it as a framing error.
Idle character
When an idle frame is detected, there is the same procedure as a data received
character plus an interrupt if the ILIE bit is set and the I bit is cleared in the CCR
register.
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PDF描述
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參數(shù)描述
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