參數(shù)資料
型號: ST72P621J4T1
廠商: STMICROELECTRONICS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO34
封裝: PLASTIC, SO-34
文件頁數(shù): 6/136頁
文件大?。?/td> 2475K
代理商: ST72P621J4T1
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OPERATING CONDITIONS (Cont’d)
Figure 56. fCPU Versus VDD for low voltage devices
12.3.2 Operating Conditions with Low Voltage Detector (LVD)
Subject to general operating conditions for VDD, fCPU, and TA. Refer to Figure 15 on page 21.
Notes:
1. Not tested, guaranteed by design.
2. Not tested in production, guaranteed by characterization.
3. The VDD rise time rate condition is needed to insure a correct device power-on and LVD reset. Not tested in production.
fCPU [MHz]
SUPPLY VOLTAGE [V]
8
4
2
0
2.5
3.0
3.5
4
4.5
5
5.5
FUNCTIONALITY
NOT GUARANTEED
IN THIS AREA
FUNCTIONALITY
GUARANTEED
IN THIS AREA
(UNLESS OTHERWISE
SPECIFIED IN THE
TABLES OF
PARAMETRIC DATA)
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
VIT+
Low Voltage Reset Threshold (VDD rising)
VDD Max. Variation 50V/ms
3.6
3.8
3.95
V
VIT-
Low Voltage Reset Threshold (VDD falling)
VDD Max. Variation 50V/ms
3.45
3.65
3.8
V
Vhyst
Hysteresis (VIT+ - VIT-)
120 2)
150 2)
180 2)
mV
VtPOR
VDD rise time rate
3)
0.5
50
V/ms
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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