參數(shù)資料
型號： SX8722I070TRLF
廠商： Semtech
文件頁數(shù)： 101/108頁
文件大?。?/td> 0K
描述： IC ZOOMING ADC 10BIT 16CH 44MLPQ
標準包裝： 1
類型： 壓力傳感器
輸入類型： 邏輯
輸出類型： 邏輯
接口： I²C
電流 - 電源： 300µA
安裝類型： 表面貼裝
封裝/外殼： 44-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 44-MLPQ（7x7）
包裝： 標準包裝
產(chǎn)品目錄頁面： 585 (CN2011-ZH PDF)
配用： XE8000EV120-ND - BOARD EVAL FOR SX8722I070TRLF
其它名稱： SX8722I070LFDKR
ACS - Revision 4.2
October 2008
2008 Semtech Corp.
www.semtech.com
Page 92
ADVANCED COMMUNICATIONS & SENSING
DATASHEET
SX8722
High gain acquisition for sensor interface
14.2.4. Configuration 3 registers
Table 102. C3ZAdcReg1 (0x4A)
Table 103. C3ZAdcReg2 (0x4B)
Table 104. C3ZAdcReg3 (0x4C)
Table 105. C3ZAdcReg4 (0x4D)
Bit
Name
Mode
Reset
Description
7
reserved
r
x
6:5
SET_NELC
rw
01
Sets the number of elementary conversion to 2SET_NELC[1:0]. To
compensate for offset the signal is chopped between elementary
conversion.
4:2
SET_OSR
rw
010
Sets the ADC over-sampling rate of an elementary conversion to
23+SET_OSR[2:0].
1
reserved
r
x
0
reserved
r
x
Bit
Name
Mode
Reset
Description
7:6
IB_AMP_ADC[1:0]
rw
11
Bias current selection of the A/D converter.
5:4
IB_AMP_PGA[1:0]
rw
11
Bias current selection of the PGA stages.
3:0
ENABLE[3:0]
rw
0000
Enables the different PGA stages and ADC.
XXX1 - ADC enable
XX1X - PGA3 enable
X1XX - PGA2 enable
1XXX - PGA1 enable
Bit
Name
Mode
Reset
Description
7:6
FIN[1:0]
rw
00
Sampling frequency selection
5:4
PGA2_GAIN[1:0]
rw
00
PGA2 stage gain selection
3:0
PGA2_OFFSET[3:0]
rw
0000
PGA2 stage offset selection
Bit
Name
Mode
Reset
Description
7
PGA1_GAIN
rw
0
PGA1 stage gain selection
6:0
PGA3_GAIN[6:0]
rw
0000000 PGA3 stage gain selection
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PDF描述
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