參數(shù)資料
型號(hào)： TINY88-15MZ
廠商： Atmel
文件頁(yè)數(shù)： 30/245頁(yè)
文件大?。?/td> 0K
描述： MCU AVR 8KB FLASH 12MHZ 32-QFN
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
tinyAVR Introduction
標(biāo)準(zhǔn)包裝： 5,000
系列： AVR® ATtiny
核心處理器： AVR
芯體尺寸： 8-位
速度： 16MHz
連通性： I²C，SPI
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，WDT
輸入/輸出數(shù)： 28
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
EEPROM 大小： 64 x 8
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 32-VFQFN 裸露焊盤
包裝： 托盤
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125
9157C–AVR–03/12
Atmel ATtiny88 Automotive
Data bits are shifted out and latched in on opposite edges of the SCK signal, ensuring sufficient
time for data signals to stabilize. This is clearly seen by summarizing Table 14-3 on page 125
and Table 14-4 on page 126, as done in Table 14-2 below.
14.5
Register Description
14.5.1
SPCR – SPI Control Register
Bit 7 – SPIE: SPI Interrupt Enable
This bit causes the SPI interrupt to be executed if SPIF bit in the SPSR Register is set and the if
the Global Interrupt Enable bit in SREG is set.
Bit 6 – SPE: SPI Enable
When the SPE bit is written to one, the SPI is enabled. This bit must be set to enable any SPI
operations.
Bit 5 – DORD: Data Order
When the DORD bit is written to one, the LSB of the data word is transmitted first.
When the DORD bit is written to zero, the MSB of the data word is transmitted first.
Bit 4 – MSTR: Master/Slave Select
This bit selects Master SPI mode when written to one, and Slave SPI mode when written logic
zero. If SS is configured as an input and is driven low while MSTR is set, MSTR will be cleared,
and SPIF in SPSR will become set. The user will then have to set MSTR to re-enable SPI Mas-
ter mode.
Bit 3 – CPOL: Clock Polarity
When this bit is written to one, SCK is high when idle. When CPOL is written to zero, SCK is low
when idle. Refer to Figure 14-3 and Figure 14-4 for an example. The CPOL functionality is sum-
marized below:
Table 14-2.
Setting SPI Mode using Control Bits CPOL and CPHA
CPOL
CPHA
SPI Mode
Leading Edge
Trailing eDge
0
Sample (Rising)
Setup (Falling)
0
1
Setup (Rising)
Sample (Falling)
1
0
2
Sample (Falling)
Setup (Rising)
1
3
Setup (Falling)
Sample (Rising)
Bit
7
65
43
21
0
SPIE
SPE
DORD
MSTR
CPOL
CPHA
SPR1
SPR0
SPCR
Read/Write
R/W
Initial Value
0
Table 14-3.
CPOL Functionality
CPOL
Leading Edge
Trailing Edge
0
Rising
Falling
1
Falling
Rising
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PDF描述
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TIOL111DMWT 功能描述:IO-LINK DEVICE TRANSCEIVERS WITH 制造商:texas instruments 系列:- 包裝:剪切帶（CT） 零件狀態(tài):在售 類型:收發(fā)器 協(xié)議:I/O 鏈路 驅(qū)動(dòng)器/接收器數(shù):1/1 雙工:- 接收器滯后:750mV 數(shù)據(jù)速率:250kbps 電壓 - 電源:7 V ~ 36 V 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 封裝/外殼:10-VFDFN 裸露焊盤 供應(yīng)商器件封裝:10-VSON（3x2.5） 標(biāo)準(zhǔn)包裝:1
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