參數(shù)資料
型號： TMP91FW60FG
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件頁數(shù)： 76/322頁
文件大?。?/td> 4595K
代理商： TMP91FW60FG
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Page 163
2007-10-15
TMP91FW60
9.3.2
I2C Bus Mode Control Register
The following registers are used to control and monitor the operation status when using the serial bus inter-
face (SBI) in the I2C bus mode.
Serial Bus Interface Control Register 0 (Read-modify-write instructions are prohibited.)
765
43210
SBI0CR0
(0247H)
Bit symbol
SBI0EN
––
–––––
Read/Write
R/W
R
After reset
000
00000
SBI1CR0
(024FH)
Bit symbol
SBI1EN
––
–––––
Read/Write
R/W
R
After reset
000
00000
Function
SBI
operation
0: disable
1: enable
Always read "0".
Note <SBIEN>: When using SBI, <SBIEN> should be set "1" (SBI operation enable) before setting each register of SBI module.
Serial Bus Interface Control Register 1 (Read-modify-write instructions are prohibited.)
765
4
3
2
1
0
SBI0CR1
(0240H)
Bit symbol
BC2
BC1
BC0
ACK
–
SCK2
SCK1
SCK0/
SWRMON
Read/Write
W
R/W
–
W
R/W
After reset
000
0
–
0
0/1
SBI1CR1
(0248H)
Bit symbol
BC2
BC1
BC0
ACK
–
SCK2
SCK1
SCK0/
SWRMON
Read/Write
W
R/W
–
W
R/W
After reset
000
0
–
0
0/1
Function
Number of transferred bits
(Note 1)
Acknowl-
edge mode
specification
Internal serial clock selection and software
reset monitor
(Note 2)
Internal serial clock selection <SCK2:0> at write
SCK2:0
000
n = 4
– (Note3)
System clock: fc
Clock gear: fc/1
fc =20 MHz (Internal SCL output)
fscl = (fSYS/2) / (2
n+36) [Hz]
001
n = 5
73.53 kHz
010
n = 6
50.00 kHz
011
n = 7
30.49 kHz
100
n = 8
17.12 kHz
101
n = 9
9.12 kHz
110
n = 10
4.72 kHz
111
(Reserved)
Software reset state monitor <SWRMON> at read
SWRMON
0
During software reset
1
Initial data
Acknowledge mode specification
ACK
0
Not generate clock pulse for acknowledge signal
1
Generate clock pulse for acknowledge signal
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PDF描述
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