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參數(shù)資料
| 型號： | TMS320C6416TBZLZD1 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 126/146頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIXED-POINT DSP 532-FCBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | TMS320C6414T/15T/16T |
| 類型： | 定點 |
| 接口： | 主機(jī)接口，McBSP，PCI，UTOPIA |
| 時鐘速率： | 1.0GHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 1.03MB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.20V |
| 工作溫度： | -40°C ~ 90°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 532-BFBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 532-FCBGA（23x23） |
| 包裝： | 托盤 |
| 配用： | 701891-ND - KIT STARTER DSP FOR C6416T TMDXEVM6452-ND - TMDXEVM6452 296-23038-ND - DSP STARTER KIT FOR TMS320C6416 |
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TMS320C6414T, TMS320C6415T, TMS320C6416T
FIXEDPOINT DIGITAL SIGNAL PROCESSORS
SPRS226M NOVEMBER 2003 REVISED APRIL 2009
80
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
INPUT AND OUTPUT CLOCKS
timing requirements for CLKIN for -600 devices§ (see Figure 16)
600
NO.
PLL MODE x20
PLL MODE x12
PLL MODE x6
x1 (BYPASS)
UNIT
NO.
MIN
MAX
MIN
MAX
MIN
MAX
MIN
MAX
UNIT
1
tc(CLKIN)
Cycle time, CLKIN
33.3
40
20
23.8
13.3
23.8
0
10
ns
2
tw(CLKINH) Pulse duration, CLKIN high
0.4C
0.45C
ns
3
tw(CLKINL)
Pulse duration, CLKIN low
0.4C
0.45C
ns
4
tt(CLKIN)
Transition time, CLKIN
5
1
ns
5
tJ(CLKIN)
Period jitter, CLKIN
0.02C
ns
The reference points for the rise and fall transitions are measured at VIL MAX and VIH MIN.
For more details on the PLL multiplier factors (x6, x12, x20), see the Clock PLL section of this data sheet.
§ C = CLKIN cycle time in ns. For example, when CLKIN frequency is 50 MHz, use C = 20 ns.
timing requirements for CLKIN for -720 devices§ (see Figure 16)
720
NO.
PLL MODE x20
PLL MODE x12
PLL MODE x6
x1 (BYPASS)
UNIT
NO.
MIN
MAX
MIN
MAX
MIN
MAX
MIN
MAX
UNIT
1
tc(CLKIN)
Cycle time, CLKIN
27.7
40
16.6
23.8
13.3
23.8
0
10
ns
2
tw(CLKINH) Pulse duration, CLKIN high
0.4C
0.45C
ns
3
tw(CLKINL)
Pulse duration, CLKIN low
0.4C
0.45C
ns
4
tt(CLKIN)
Transition time, CLKIN
5
1
ns
5
tJ(CLKIN)
Period jitter, CLKIN
0.02C
ns
The reference points for the rise and fall transitions are measured at VIL MAX and VIH MIN.
For more details on the PLL multiplier factors (x6, x12, x20), see the Clock PLL section of this data sheet.
§ C = CLKIN cycle time in ns. For example, when CLKIN frequency is 50 MHz, use C = 20 ns.
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PDF描述 |
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參數(shù)描述 |
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