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參數(shù)資料
| 型號(hào)： | TMS320C6711GJLA167 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| 中文描述： | 定點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁數(shù)： | 73/123頁 |
| 文件大?。?/td> | 1205K |
| 代理商： | TMS320C6711GJLA167 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁當(dāng)前第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁
www.ti.com
SYSRS
Data[16]
SYSCLKOUT
Data[16]
Addr[16]
Control
I2CINT1A
I2CINT2A
C28X CPU
GPIO
MUX
I
2
CA
System Control
Block
I2CAENCLK
PIE
Block
SDAA
SCLA
P
TMS320F2808, TMS320F2806
TMS320F2801, UCD9501
Digital Signal Processors
SPRS230F–OCTOBER 2003–REVISED SEPTEMBER 2005
A.
The I
2
C registers are accessed at the SYSCLKOUT rate. The internal timing and signal waveforms of the I
2
C port are
also at the SYSCLKOUT rate.
The clock enable bit (I2CAENCLK) in the PCLKCRO register turns off the clock to the I
2
C port for low power
operation. Upon reset, I2CAENCLK is clear, which indicates the peripheral internal clocks are off.
B.
Figure 4-15. I
2
C Peripheral Module Interfaces
The registers in
Table 4-14
configure and control the I
2
C port operation.
Table 4-14. I
2
C-A Registers
NAME
I2COAR
I2CIER
I2CSTR
I2CCLKL
I2CCLKH
I2CCNT
I2CDRR
I2CSAR
I2CDXR
I2CMDR
I2CISRC
I2CPSC
I2CFFTX
I2CFFRX
I2CRSR
I2CXSR
ADDRESS
0x7900
0x7901
0x7902
0x7903
0x7904
0x7905
0x7906
0x7907
0x7908
0x7909
0x790A
0x790C
0x7920
0x7921
-
-
DESCRIPTION
I
2
C own address register
I
2
C interrupt enable register
I
2
C status register
I
2
C clock low-time divider register
I
2
C clock high-time divider register
I
2
C data count register
I
2
C data receive register
I
2
C slave address register
I
2
C data transmit register
I
2
C mode register
I
2
C interrupt source register
I
2
C prescaler register
I
2
C FIFO transmit register
I
2
C FIFO receive register
I
2
C receive shift register (not accessible to the CPU)
I
2
C transmit shift register (not accessible to the CPU)
Peripherals
73
相關(guān)PDF資料 |
PDF描述 |
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