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參數(shù)資料
| 型號： | TMS320F28069PNT |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 157/174頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 256KB FLASH 80LQFP |
| 產(chǎn)品培訓模塊： | ControlSUITE Piccolo F2806x TPS75005 Single IC Power for C2000 MCU |
| 標準包裝： | 119 |
| 系列： | TMS320F2806x, Piccolo™, C2000™ |
| 核心處理器： | C28x |
| 芯體尺寸： | 32-位 |
| 速度： | 80MHz |
| 連通性： | CAN，I²C，McBSP，SCI，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 256KB（128K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 50K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.71 V ~ 1.995 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 托盤 |
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0,
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Digital
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input
when
V
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Input
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REFHI
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3.3
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SPRS698D – NOVEMBER 2010 – REVISED DECEMBER 2012
5.10.1 Analog-to-Digital Converter (ADC)
5.10.1.1 Features
The core of the ADC contains a single 12-bit converter fed by two sample-and-hold circuits. The sample-
and-hold circuits can be sampled simultaneously or sequentially. These, in turn, are fed by a total of up to
16 analog input channels. The converter can be configured to run with an internal bandgap reference to
create true-voltage based conversions or with a pair of external voltage references (VREFHI/VREFLO) to
create ratiometric-based conversions.
Contrary to previous ADC types, this ADC is not sequencer-based. The user can easily create a series of
conversions from a single trigger. However, the basic principle of operation is centered around the
configurations of individual conversions, called SOCs, or Start-Of-Conversions.
Functions of the ADC module include:
12-bit ADC core with built-in dual sample-and-hold (S/H)
Simultaneous sampling or sequential sampling modes
Full range analog input: 0 V to 3.3 V fixed, or VREFHI/VREFLO ratiometric. The digital value of the input
analog voltage is derived by:
–
Internal Reference (VREFLO = VSSA. VREFHI must not exceed VDDA when using either internal or
external reference modes.)
–
External Reference (VREFHI/VREFLO connected to external references. VREFHI must not exceed VDDA
when using either internal or external reference modes.)
Runs at full system clock, no prescaling required
Up to 16-channel, multiplexed inputs
16 SOCs, configurable for trigger, sample window, and channel
16 result registers (individually addressable) to store conversion values
Multiple trigger sources
–
S/W – software immediate start
–
ePWM 1–8
–
GPIO XINT2
–
CPU Timer 0, CPU Timer 1, CPU Timer 2
–
ADCINT1, ADCINT2
9 flexible PIE interrupts, can configure interrupt request after any conversion
Copyright 2010–2012, Texas Instruments Incorporated
Peripheral and Electrical Specifications
83
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PDF描述 |
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