參數(shù)資料
型號(hào): TSC21020F-20MBSL2
英文描述: IC CYCLONE III FPGA 25K 324-FBGA
中文描述: 數(shù)字信號(hào)處理器| 32位|的CMOS | RAD數(shù)據(jù)通信硬| QFL | 256PIN |陶瓷
文件頁數(shù): 37/51頁
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代理商: TSC21020F-20MBSL2
37
TSC21020F
4153F
AERO
06/03
Figure 10.
Memory Read
Memory Write
Parameter
20 MHz
Frequency
Dependency
(1)
Unit
Min
Max
Min
Max
t
DAAK
xACK Delay from
Address, Select
27
27 + 7DT/8
ns
t
DWAK
xACK Delay from xWR
Low
15
15 + DT/2
ns
t
SAK
xACK Setup before CLKIN
High
14
14 + DT/4
ns
t
HAK
xACK Hold after CLKIN
High
0
ns
t
DAWH
Address, Select to xWR
Deasserted
37
37 +
15DT/16
ns
t
DAWL
Address, Select to xWR
Low
11
11 + 3DT/8
ns
t
WW
xWR Pulse Width
26
26 +
9DT/16
ns
t
DDWH
Data Setup before xWR
High
23
23 + DT/2
ns
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