參數(shù)資料
型號(hào)： UPD17068
廠商： NEC Corp.
英文描述： 4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS
中文描述： 4位單片機(jī)包含圖片顯示控制器和鎖相環(huán)頻率合成數(shù)字調(diào)諧系統(tǒng)
文件頁(yè)數(shù)： 15/341頁(yè)
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代理商： UPD17068
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15
μ
PD17068
19. STANDBY .................................................................................................................................... 278
19.1
STANDBY FUNCTIONS..................................................................................................................
19.2
HALT FUNCTION ............................................................................................................................
19.2.1
General ............................................................................................................................
19.2.2
Halt State ........................................................................................................................
19.2.3
Halt Release Conditions ................................................................................................
19.2.4
Halt Release by Key Input.............................................................................................
19.2.5
Halt Release by Basic Timer 0......................................................................................
19.2.6
Halt Release by Interrupt ..............................................................................................
19.2.7
When Multiple Release Conditions Set Simultaneously..........................................
19.3
CLOCK-STOP FUNCTION ..............................................................................................................
19.3.1
Clock-Stop State ............................................................................................................
19.3.2
Clock-Stop State Release..............................................................................................
19.3.3
Clock-Stop Release by CE Reset ..................................................................................
19.3.4
Clock-Stop Release by Power-On Reset .....................................................................
19.3.5
Clock-Stop Release by R1B
2
/RLS
STP
Pin .....................................................................
19.3.6
Cautions When Using Clock-Stop Instruction ...........................................................
19.4
DEVICE OPERATION AT HALT AND CLOCK-STOP....................................................................
19.5
PIN PROCESSING CAUTIONS IN HALT STATE AND CLOCK-STOP STATE...........................
19.6
DEVICE OPERATION CONTROL BY CE PIN ................................................................................
19.6.1
Image Display Controller (IDC) Operation Control....................................................
19.6.2
PLL Frequency Synthesizer Operation Control .........................................................
19.6.3
Clock-Stop Instruction Disable/Enable Control.........................................................
19.6.4
Device Reset ...................................................................................................................
19.6.5
Signal Input to CE Pin ...................................................................................................
19.6.6
Organization and Functions of CE Pin Level Judge Register ..................................
19.6.7
Organization and Functions of CE Pin Edge Detection Register ............................
278
280
280
280
280
281
283
283
286
287
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292
293
296
296
296
296
296
297
297
298
20. Reset ............................................................................................................................................ 299
20.1
RESET BLOCK CONFIGURATION.................................................................................................
20.2
RESET FUNCTION ..........................................................................................................................
20.3
CE RESET.........................................................................................................................................
20.3.1
CE Reset When Clock-Stop (STOP s Instruction) Not Used ....................................
20.3.2
CE Reset When Clock-Stop (STOP s Instruction) Used............................................
20.3.3
Cautions at CE Reset .....................................................................................................
20.4
POWER-ON RESET .........................................................................................................................
20.4.1
Power-On Reset at Normal Operation ........................................................................
20.4.2
Power-On Reset in Clock-Stop State ..........................................................................
20.4.3
Power-On Reset When V
DD
Rises From 0 V ...............................................................
20.5
RELATIONSHIP BETWEEN CE RESET AND POWER-ON RESET ..............................................
20.5.1
When V
DD
Pin and CE Pin Rise Simultaneously.........................................................
20.5.2
When CE Pin Raised in Forced Halt State Caused by Power-On Reset.................
20.5.3
When CE Pin Raised After Power-On Reset...............................................................
20.5.4
Cautions When V
DD
Raised ...........................................................................................
20.6
POWER FAILURE DETECTION ......................................................................................................
20.6.1
Power Failure Detection Circuit ...................................................................................
20.6.2
Cautions at Power Failure Detection with BTM0CY Flag ........................................
20.6.3
Power Failure Detection by RAM Judgment .............................................................
20.6.4
Cautions at Power Failure Detection by RAM Judgment ........................................
299
300
301
301
302
303
304
305
305
305
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相關(guān)PDF資料
PDF描述
UPD17068GF 4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS
UPD17068GF-E 4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS
UPD17072 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM
UPD17073GB 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM
UPD17073 FILTER BAND PASS 5.8GHZ SMD
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參數(shù)描述
UPD17068GF 制造商:NEC 制造商全稱(chēng):NEC 功能描述:4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS
UPD17068GF-E 制造商:NEC 制造商全稱(chēng):NEC 功能描述:4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS
UPD17068GF-EXX3BA 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:4-Bit Microcontroller
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