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參數(shù)資料
| 型號： | UPD17068GF |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS |
| 中文描述： | 4位單片機包含圖片顯示控制器和鎖相環(huán)頻率合成數(shù)字調(diào)諧系統(tǒng) |
| 文件頁數(shù)： | 140/341頁 |
| 文件大?。?/td> | 1881K |
| 代理商： | UPD17068GF |
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140
μ
PD17068
12.3 BASIC TIMER 1
12.3.1 Overview of Basic Timer 1
Fig. 12-11 shows the block diagram of basic timer 1.
Basic timer 1 is realized by detecting the state of a flip-flop that is set at constant intervals, using the BTM1CY
flag (bit 0 at address RF:16H).
The contents of the flip-flop corresponds the states of the BTM1CY flag on a one-to-one basis.
Basic timer 1 can use an external clock input at the P1B
3
/TMIN pin as its base clock. It can also detect the
zero cross of the external clock.
Fig. 12-11 Block Diagram of Basic Timer 1
BTM1ZX flag
8 MHz
P1B
3
/TMIN
(external clock)
BTM1EXCK flag
BTM1CK1 flag
BTM1CK0 flag
Selector
Flip-
flop
Set/clear
BTM1CY flag
Zero-cross
detection
circuit
Frequency
divider
Clock selection block
Remarks 1.
BTM1EXCK (bit 3 of basic timer 1 mode select register; see
Fig. 12-12
) specifies the base clock
(internal or external clock).
2.
BTM1ZX (bit 2 of basic timer 1 mode select register; see
Fig. 12-12
) specifies whether the zero-
cross detection circuit is on or off.
3.
BTM1CK1 and BTM1CK0 (bits 1 and 0 of the basic timer 1 mode select register, respectively;
see
Fig. 12-12
) specify the time interval at which the BTM1CY flag is set.
4.
BTM1CY (bit 0 of the basic timer 1 carry flip-flop judge register; see
Fig. 12-13
) reflects the state
of the flip-flop.
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PDF描述 |
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