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參數(shù)資料
| 型號： | UPD44324185F5-E40-EQ2 |
| 廠商： | NEC Corp. |
| 英文描述： | 36M-BIT DDRII SRAM SEPARATE I/O 2-WORD BURST OPERATION |
| 中文描述： | 36M條位條DDRII SRAM的分離I / O 2字爆發(fā)運作 |
| 文件頁數(shù)： | 2/32頁 |
| 文件大?。?/td> | 360K |
| 代理商： | UPD44324185F5-E40-EQ2 |
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2
Preliminary Data Sheet
M16782EJ1V0DS
μ
PD44324085, 44324095, 44324185, 44324365
Ordering Information
Part number
Cycle
Clock
Organization Core Supply
I/O
Package
Time
Frequency
(word x bit)
Voltage
Interface
ns
MHz
V
μ
PD44324085F5-E33-EQ2
Note
3.3
300
4 M x 8-bit
1.8 ± 0.1
HSTL
165-pin PLASTIC
μ
PD44324085F5-E40-EQ2
4.0
250
FBGA (13 x 15)
μ
PD44324085F5-E50-EQ2
5.0
200
μ
PD44324095F5-E33-EQ2
Note
3.3
300
4 M x 9-bit
μ
PD44324095F5-E40-EQ2
4.0
250
μ
PD44324095F5-E50-EQ2
5.0
200
μ
PD44324185F5-E33-EQ2
Note
3.3
300
2 M x 18-bit
μ
PD44324185F5-E40-EQ2
4.0
250
μ
PD44324185F5-E50-EQ2
5.0
200
μ
PD44324365F5-E33-EQ2
Note
3.3
300
1M x 36-bit
μ
PD44324365F5-E40-EQ2
4.0
250
μ
PD44324365F5-E50-EQ2
5.0
200
Note
Under development
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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