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參數(shù)資料
| 型號： | UPD485505 |
| 廠商： | NEC Corp. |
| 英文描述： | LINE BUFFER 5K-WORD BY 8-BIT |
| 中文描述： | 行緩沖區(qū)5K - Word的8位 |
| 文件頁數(shù)： | 13/20頁 |
| 文件大?。?/td> | 174K |
| 代理商： | UPD485505 |
μ
PD485505
13
Data Sheet M10059EJ7V0DS00
4. Application
4.1 1 H Delay Line
μ
PD485505 easily allows a 1 H (5,048 bits) delay line (see
Figure 4.1
).
Figure 4.1 1 H Delay Line Circuit
WCK
D
IN
WE
RSTW
RCK
D
OUT
RE
RSTR
40 MHz Clock
Reset
Data Output
Data Input
8
8
Figure 4.2 1 H Delay Line Timing Chart
t
WCK
t
RCK
Cycle 0
Cycle 1
Cycle 2
1 H
(5,048 Cycles)
Cycle 5,047
Cycle 0’
Cycle 0
2 H
(5,048 Cycles)
t
WCW
t
RCW
t
WCP
t
RCP
t
RS
t
RH
t
DH
t
DS
(0)
(1)
(2)
(5,046)
(5,047)
(0’)
(1’)
t
DH
t
OH
t
AC
(0)
(1)
(2’)
(3’)
(2)
(3)
WCK/RCK
(Input)
RSTW /
RSTR
(Input)
D
IN
(Input)
D
OUT
(Output)
t
DS
Cycle 1’
Cycle 1
Cycle 2’
Cycle 2
Cycle 3’
Cycle 3
Write
Read
Remark
RE, WE = “L” level
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD485505G-25 | LINE BUFFER 5K-WORD BY 8-BIT |
| UPD485505G-35 | LINE BUFFER 5K-WORD BY 8-BIT |
| UPD4990A | SERIAL I/O CALENDAR & CLOCK CMOS LSI |
| UPD4990AC | SERIAL I/O CALENDAR & CLOCK CMOS LSI |
| UPD4990AG | SERIAL I/O CALENDAR & CLOCK CMOS LSI |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD485505-2G | 制造商:NEC Electronics Corporation 功能描述: |
| UPD485505G-25 | 制造商:NEC Electronics Corporation 功能描述: |
| uPD485505G-25-A | 制造商:Renesas Electronics 功能描述:18ns 5V Cut Tape |
| UPD485505G-35-A | 制造商:Renesas Electronics 功能描述:25ns 5V Cut Tape |
| UPD485506G5-25-7JF | 制造商:NEC Electronics Corporation 功能描述: 制造商:NEC Electronics Corporation 功能描述:FIELD/FRAME/LINE MEMORY, 44 Pin, Plastic, TSOP |
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