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參數(shù)資料
| 型號： | UPD72001G-11-22 |
| 廠商： | NEC Corp. |
| 英文描述： | MULTI-PROTOCOL SERIAL CONTROLLERS |
| 中文描述： | 多協(xié)議串行控制器 |
| 文件頁數(shù)： | 8/40頁 |
| 文件大?。?/td> | 206K |
| 代理商： | UPD72001G-11-22 |
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μ
PD72001-11, 72001-A8
8
Table 1-1. Pin Status at Reset
Pin Name
I/O
Pin Status
RESET (system reset)
Channel reset
WR
I
–
–
RD
I
–
–
B/A
I
–
–
C/D
I
–
–
D7 to D0
I/O
–
–
INT
O
High impedance
High impedance
INTAK
I
–
–
PRI
I
–
–
PRO
O
Depends on PRI
Depends on PRI
DRQT
X
A
O
“L”
“L”
DRQR
X
A
O
“L”
“L”
DTRA/DRQT
X
B,
DTRB/DRQR
X
B
O
DTR function, “H”
Retains current status
T
X
DA, T
X
DB
O
“H”
“H”
R
X
DA, R
X
DB
I
–
–
TR
X
CA, TR
X
CB
I/O
Input status
Retains current status
XI1A/STR
X
CA
XI1B/STR
X
CB
I
–
–
XI2A/SYNCA
XI2B/SYNCB
I/O
Input status
Retains current status
RTSA, RTSB
O
“H”
“H”
CTSA, CTSB
I
–
–
DCDA, DCDB
I
–
–
– : Undefined
(4) CLK (System Clock) ... Input
This pin inputs the system clock. The input frequency must be five times that of the data transfer rate or higher.
(5) WR (Write) ... Input
This pin inputs a write control signal for control words and transmit data. This pin is active-low.
(6) RD (Read) ... Input
This pin inputs a read control signal for status and receive data. This pin is active-low.
(7) B/A (Channel B/Channel A) ... Input
This pin inputs a signal to select a channel to be accessed when data is written or read. When this pin is “L”,
channel A is selected; when it is “H”, channel B is selected.
(8) C/D (Control/Data) ... Input
This pin inputs a signal that determines the type of the data on the data bus when the data is written or read.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD72001C-11 | MULTI-PROTOCOL SERIAL CONTROLLERS |
| UPD72001L-11 | 5015 RR 14#16 SKT RECP |
| UPD72001G-A8-22 | MULTI-PROTOCOL SERIAL CONTROLLERS |
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| UPD720101 | USB2.0 HOST CONTROLLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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