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參數(shù)資料
| 型號： | UPD75036CW |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 51/58頁 |
| 文件大?。?/td> | 485K |
| 代理商： | UPD75036CW |
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51
μ
PD75036
Parameter
Symbol
Data hold supply voltage
Data hold supply current
Note 1
Release signal setting time
Oscillation settling time
Note 2
V
DDDR
I
DDDR
t
SREL
t
WAIT
Min.
Typ.
Max.
Unit
2.0
0
0.1
2
17
/f
X
Note 3
6.0
10
V
μ
A
μ
s
ms
ms
V
DDDR
= 2.0 V
Release by RESET
Release by interrupt request
Conditions
DATA HOLD CHARACTERISTICS BY LOW SUPPLY VOLTAGE IN DATA MEMORY STOP MODE
(T
a
= -40 to +85
°
C)
Notes 1.
Excluding the current which flows through the built-in pull-up resistors
CPU operation stop time for preventing unstable operation at the beginning of oscillation
This value depends on the settings of the basic interval timer mode register (BTM) shown below.
2.
3.
Data Hold Timing (STOP Mode Release by RESET)
Data Hold Timing (Standby Release Signal: STOP Mode Release by Interrupt Signal)
—
—
—
—
0
1
0
1
0
1
1
1
BTM0
BTM1
0
0
1
1
BTM2
BTM3
2
20
/f
X
(approx. 250 ms)
2
17
/f
X
(approx. 31.3 ms)
2
15
/f
X
(approx. 7.82 ms)
2
13
/f
X
(approx. 1.95 ms)
Wait time
(Values at fx = 4.19 MHz in parentheses)
RESET
V
DD
V
DDDR
t
SREL
t
WAIT
Internal reset operation
HALT mode
Operation
mode
STOP instruction execution
Data hold mode
STOP mode
Standby release signal
(Interrupt request)
V
DD
V
DDDR
t
SREL
t
WAIT
HALT mode
Operation
mode
STOP instruction execution
Data hold mode
STOP mode
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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