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參數(shù)資料
| 型號： | UPD780022AY |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | 8位單晶片微控制器 |
| 文件頁數(shù)： | 58/90頁 |
| 文件大小： | 660K |
| 代理商： | UPD780022AY |
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μ
PD78F0034B, 78F0034BY, 78F0034B(A), 78F0034BY(A)
58
Data Sheet U16369EJ1V0DS
(3) Serial Interface (T
A
=
–
40 to +85
°
C, V
DD
= 1.8 to 5.5 V)
(a) 3-wire serial I/O mode (SCK30... Internal clock output)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK30
t
KCY1
4.0 V
≤
V
DD
≤
5.5 V
954
ns
cycle time
2.7 V
≤
V
DD
<
4.0 V
1600
ns
1.8 V
≤
V
DD
<
2.7 V
3200
ns
SCK30 high-/
t
KH1
, t
KL1
4.0 V
≤
V
DD
≤
5.5 V
t
KCY1
/2
–
50
ns
low-level width
1.8 V
≤
V
DD
<
4.0 V
t
KCY1
/2
–
100
ns
SI30 setup time
t
SIK1
4.0 V
≤
V
DD
≤
5.5 V
100
ns
(to SCK30
↑
)
2.7 V
≤
V
DD
< 4.0 V
150
ns
1.8 V
≤
V
DD
<
2.7 V
300
ns
SI3n hold time
(from SCK30
↑
)
t
KSI1
400
ns
Delay time from
SCK30
↓
to SO30
output
t
KSO1
C = 100 pF
Note
300
ns
Note
C is the load capacitance of the SCK30 and SO30 output lines.
(b) 3-wire serial I/O mode (SCK30... External clock input)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK30
4.0 V
≤
V
DD
≤
5.5 V
800
ns
cycle time
2.7 V
≤
V
DD
< 4.0 V
1600
ns
1.8 V
≤
V
DD
<
2.7 V
3200
ns
SCK30 high-/
t
KH2
, t
KL2
4.0 V
≤
V
DD
≤
5.5 V
400
ns
low-level width
2.7 V
≤
V
DD
< 4.0 V
800
ns
1.8 V
≤
V
DD
<
2.7 V
1600
ns
SI30 setup time
(to SCK30
↑
)
t
SIK2
100
ns
SI30 hold time
(from SCK30
↑
)
t
KSI2
400
ns
Delay time from
SCK30
↓
to SO30
output
t
KSO2
C = 100 pF
Note
300
ns
Note
C is the load capacitance of the SO30 output line.
t
KCY2
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