參數資料
型號： UPD78F1185AGJ-GAE-AX
廠商： Renesas Electronics America
文件頁數： 927/963頁
文件大?。?/td> 0K
描述： MCU 16BIT 78K0R/KX3 144-LQFP
標準包裝： 300
系列： 78K0R/Kx3
核心處理器： 78K/0R
芯體尺寸： 16-位
速度： 20MHz
連通性： 3 線 SIO，EBI/EMI，I²C，LIN，UART/USART
外圍設備： DMA，LVD，POR，PWM，WDT
輸入/輸出數： 127
程序存儲器容量： 192KB（192K x 8）
程序存儲器類型： 閃存
RAM 容量： 10K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數據轉換器： A/D 16x10b; D/A 2x8b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 144-LQFP
包裝： 托盤
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APPENDIX B LIST OF CAUTIONS
User’s Manual U18417EJ4V0UD
931
(24/35)
Chapter
Cl
assi
fi
cati
on
Function
Details of
Function
Cautions
Page
An interrupt will be generated if the target bit of the KRM register is set while a low
level is being input to the key interrupt input pin. To ignore this interrupt, set the
KRM register after disabling interrupt servicing by using the interrupt mask flag.
Afterward, clear the interrupt request flag and enable interrupt servicing after waiting
for the key interrupt input low-level width (250 ns or more).
p.678
Chapter
1
8
Soft
Key
interrupt
function
KRM: Key return
mode register
The bits not used in the key interrupt mode can be used as normal ports.
p.678
The STOP mode can be used only when the CPU is operating on the main system
clock. The STOP mode cannot be set while the CPU operates with the subsystem
clock. The HALT mode can be used when the CPU is operating on either the main
system clock or the subsystem clock.
p.679
When shifting to the STOP mode, be sure to stop the peripheral hardware operation
operating with main system clock before executing STOP instruction.
p.679
The following sequence is recommended for operating current reduction of the A/D
converter when the standby function is used: First clear bit 7 (ADCS) and bit 0
(ADCE) of the A/D converter mode register (ADM) to 0 to stop the A/D conversion
operation, and then execute the STOP instruction.
p.679
It can be selected by the option byte whether the internal low-speed oscillator
continues oscillating or stops in the HALT or STOP mode.
For details, see
CHAPTER 24 OPTION BYTE.
p.679
After the above time has elapsed, the bits are set to 1 in order from MOST8 and
remain 1.
p.680
Soft
The oscillation stabilization time counter counts up to the oscillation stabilization time
set by OSTS. If the STOP mode is entered and then released while the internal high-
speed oscillation clock is being used as the CPU clock, set the oscillation stabilization
time as follows.
Desired OSTC oscillation stabilization time
≤ Oscillation stabilization time set by
OSTS
Note, therefore, that only the status up to the oscillation stabilization time set by
OSTS is set to OSTC after STOP mode is released.
p.680
Hard
OSTC:
Oscillation
stabilization time
counter status
register
The X1 clock oscillation stabilization wait time does not include the time until clock
oscillation starts (“a” below).
p.680
To set the STOP mode when the X1 clock is used as the CPU clock, set OSTS
before executing the STOP instruction.
p.681
Setting the oscillation stabilization time to 20
μs or less is prohibited.
p.681
Before changing the setting of the OSTS register, confirm that the count operation of
the OSTC register is completed.
p.681
Do not change the value of the OSTS register during the X1 clock oscillation
stabilization time.
p.681
Soft
The oscillation stabilization time counter counts up to the oscillation stabilization time
set by OSTS. If the STOP mode is entered and then released while the internal
high-speed oscillation clock is being used as the CPU clock, set the oscillation
stabilization time as follows.
Desired OSTC oscillation stabilization time
≤ Oscillation stabilization time set by
OSTS
Note, therefore, that only the status up to the oscillation stabilization time set by
OSTS is set to OSTC after STOP mode is released.
p.681
Chapter
1
9
Hard
Standby
function
OSTS:
Oscillation
stabilization time
select register
The X1 clock oscillation stabilization wait time does not include the time until clock
oscillation starts (“a” below).
p.681
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PDF描述
R5F100LJABG#V0 MCU 16BIT 256KB FLASH 64FBGA
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