μPD78F950x Port 2 is a 4-bit I/O port with " />
參數(shù)資料
型號： UPD78F9502MA-CAC-A
廠商： Renesas Electronics America
文件頁數(shù)： 118/158頁
文件大?。?/td> 0K
描述： MCU 8BIT SGL CHIP
標準包裝： 400
系列： 78K0S/Kx1+
核心處理器： 78K0S
芯體尺寸： 8-位
速度： 10MHz
外圍設備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 7
程序存儲器容量： 4KB（4K x 8）
程序存儲器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 10-LSSOP（0.225"，5.72mm 寬）
包裝： 托盤
CHAPTER 4 PORT FUNCTIONS
User’s Manual U18172EJ3V0UD
60
(2)
μPD78F950x
Port 2 is a 4-bit I/O port with an output latch. Each bit of this port can be set to the input or output mode by using
port mode register 2 (PM2). When the P20 to P23 pins are used as an input port, an on-chip pull-up resistor can be
connected in 1-bit units by using pull-up resistor option register 2 (PU2).
This port can also be used for timer I/O, and external interrupt request input.
The P23 pin is also used as the EXCLK pin of the system clock oscillator. The functions of the EXCLK pin differs,
therefore, depending on the selected system clock oscillator. The following two system clock oscillators can be used.
<1>High-speed internal oscillator
The P23 pin can be used as I/O port pin.
<2>External clock input
The P23 pin is used as the EXCLK pin to input an external clock, and therefore it cannot be used as an I/O
port pin.
The system clock oscillation is selected by the option byte. For details, refer to CHAPTER 15 OPTION BYTE.
Reset signal generation sets port 2 to the input mode.
Figures 4-5 to 4-7 show the block diagrams of port 2.
<R>
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PDF描述
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