參數(shù)資料
型號： UPSD3433EV-40U6
廠商： 意法半導(dǎo)體
英文描述： Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
中文描述： Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器
文件頁數(shù)： 246/293頁
文件大小： 2039K
代理商： UPSD3433EV-40U6
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PSD module
uPSD34xx
246/293
28.5.53
Forced power-down (FDP)
An alternative to APD is FPD. The resulting power-savings is the same, but the PDN signal
in
Figure 89 on page 247
is set and Power-Down mode is entered immediately when
firmware sets the FORCE_PD Bit to logic '1' in the csiop
Register PMMR3 (Bit 1). FPD will
override APD counter activity when FORCE_PD is set. No external clock source for the APD
counter is needed. The FORCE_PD Bit is cleared only by a reset condition.
Caution must be used when implementing FPD because code memory goes off-line as
soon as PSD Module Power-Down mode is entered, leaving the MCU with no instruction
stream to execute.
The MCU Module must put itself into Power-Down mode after it puts the PSD Module into
Power-Down Mode. How can it do this if code memory goes off-line The answer is the Pre-
Fetch Queue (PFQ) in the MCU Module. By using the instruction scheme shown in the 8051
assembly code example in
Table 147
, the PFQ will be loaded with the final instructions to
command the MCU Module to Power Down mode after the PDS Module goes to Power-
Down mode. In this case, even though the code memory goes off-line in the PSD Module,
the last few MCU instruction are sourced from the PFQ.
Table 147.
PDOWN:
Forced power-down example
ANL
ORL
MOV
A8h, #7Fh
9Dh, #C0h
DPTR, #xxC7
; disable all interrupts
; ensure PFQ and BC are enabled
; load XDATA pointer to select PMMR3 register (xx
= base
; address of csiop registers)
; clear A
; first loop - fill PFQ/BQ with Power Down
instructions
; second loop - fetch code from PFQ/BC and set
Power-
; Down bits for PSD Module and then MCU
Module
; set FORCE_PD Bit in PMMR3 in PSD Module in
second
; loop
; set PD Bit in PCON Register in MCU Module in
second
; loop
; set power-down bit in the A Register, but not in
PMMR3 or
; PCON yet in first loop
; uPSD enters into Power-Down mode in second
loop
CLR
JMP
A
LOOP
NOP
LOOP:
MOVX
@DPTR, A
MOV
87h, A
MOV
A, #02h
JMP
LOOP
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PDF描述
UR132-26-AE3-5-R 200mA LOW DROPOUT LINEAR VOLTAGE REGULATOR
URS1A101MRD ALUMINUM ELECTROLYTIC CAPACITORS
URU1V470MRD ALUMINUM ELECTROLYTIC CAPACITORS
URZ1A101MPD ALUMINUM ELECTROLYTIC CAPACITORS
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參數(shù)描述
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UPSD3434E-40T6 功能描述:8位微控制器 -MCU uPSD34x Turbo Plus Fast Turbo 8032 MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3434E-40U6 功能描述:8位微控制器 -MCU 8 BITS MICROCONTR RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3434EB40T6 功能描述:8位微控制器 -MCU Turbo 8032 MCU w/USB & Programmable Logic RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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