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參數(shù)資料
| 型號： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 19/112頁 |
| 文件大小： | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機(jī)接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
- 10 -
Pin configuration table, continued.
SYMBOL
PIN
I/O
FUNCTION
GP72
MPS2_CLK
46
I/O16tsh
General Purpose I/O Function
Mouse PS2 Clock Signal
GP71
KPS2_DAT
47
I/O16tsh
General Purpose I/O Function
Keyboard PS2 Data Signal
GP70
KPS2_CLK
48
I/O16tsh
General Purpose I/O Function
Keyboard PS2 Clock Signal
VCC1
49
Ivdd
Normal Power Input, +3.3V
RESET#
50
Its
System Reset.
LCLK
51
Its
PCI clock input. Same 33MHz clock as PCI clock
on the host.
Same clock phase with typical PCI skew.
LFRAME#
52
Its
Indicates start of a new cycle or termination of a
broken cycle.
LRESET#
53
Its
Reset signal. It can connect to PCIRST# signal on
the host.
SERIRQ
54
I/O24ts
Serial IRQ input/Output.
GND
55
Ivss
Normal GND
LAD0
56
I/O24ts
LAD[3..0] are multiplexed address, control, and
data in LPC bus.
LAD1
57
I/O24ts
LAD[3..0] are multiplexed address, control, and
data in LPC bus.
LAD2
58
I/O24ts
LAD[3..0] are multiplexed address, control, and
data in LPC bus.
LAD3
59
I/O24ts
LAD[3..0] are multiplexed address, control, and
data in LPC bus.
LPWRSTS
60
Its
Power status. Indicates current power status of
LPC interface.
GP47
61
I/O16tsh
General Purpose I/O Function
GP46
CLKRUN#
62
I/O16tsh
General Purpose I/O Function
Advance LPC function: It is used to request starting
the clock
GP45
GATE_A20
63
I/O16tsh
General Purpose I/O Function
Gate A20 output
GP44
KBRST#
64
I/O16tsh
General Purpose I/O Function
CPU reset output
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