參數(shù)資料
型號(hào)： W921C840
英文描述： Microcontroller
中文描述： 微控制器
文件頁數(shù)： 19/53頁
文件大?。?/td> 394K
代理商： W921C840
W921E400A/W921C400
Publication Release Date: July 1999
- 19 -
Revision A3
SRINV register: (address = 00CH, default data = 0H)
b3
b2
b1
b0
0: Serial data latch at WCLK/RCLK rising edge
(normal high)
1: Serial data latch at WCLK/RCLK falling edge
(normal low)
0: WCLK and RCLK pins work as the internal
clock output pin
1: WCLK and RCLK pins work as the external
clock input pin
1: WCLK and WDATA enable
1: RCLK and RDATA enable
0: RCLK and RDATA disable (H-Z)
0: WCLK and WDATA disable (H-Z)
The serial interface configuration is shown below:
P6IO.2
P6IO.1
P6IO.0
SRINV.2
SRINV.3
SDATA
SCLK
Serial Buffer
Registers
050H
14EH
WDATA
WCLK
RDATA
RCLK
P6.0
P6.1
P6.2
P6.3
To Port P6 Normal I/O Register
P6IO.3
To Port P6
System
Clock
1/4
Serial Clock Speed
Control Circuit
f
SYS
Serial/Parallel
I/O Buffer
Clock Source
and Latch
Control Circuit
VDD
Port P6 Pull-High Resisters
P6PH
High Speed
Clock
The internal serial clock can be controlled by the serial clock speed control register (SRSPC) and the
format is as follows:
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PDF描述
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參數(shù)描述
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