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參數(shù)資料
| 型號： | XA2C384-10TQG144I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 12/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CPLD 384MCELL 118 I/O 144TQFP |
| 產(chǎn)品培訓模塊： | CoolRunner-II CPLD Starter Kit |
| 標準包裝： | 60 |
| 系列： | CoolRunner II |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時間 tpd(1)： | 9.2ns |
| 電壓電源 - 內(nèi)部： | 1.7 V ~ 1.9 V |
| 邏輯元件/邏輯塊數(shù)目： | 24 |
| 宏單元數(shù)： | 384 |
| 門數(shù)： | 9000 |
| 輸入/輸出數(shù)： | 118 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應商設備封裝： | 144-TQFP（20x20） |
| 包裝： | 托盤 |
XA2C384 CoolRunner-II Automotive CPLD
2
DS556 (v1.1) May 5, 2007
Product Specification
R
DataGATE is a method to selectively disable inputs of the
CPLD that are not of interest during certain points in time.
By mapping a signal to the DataGATE function, lower power
can be achieved due to reduction in signal switching.
Another feature that eases voltage translation is I/O bank-
ing. Four I/O banks are available on the CoolRunner-II
Automotive 384 macrocell device that permit easy interfac-
ing to 3.3V, 2.5V, 1.8V, and 1.5V devices.
The CoolRunner-II Automotive 384-macrocell CPLD is I/O
compatible with various I/O standards (see Table 1). This
device is also 1.5V I/O compatible with the use of
Schmitt-trigger inputs.
RealDigital Design Technology
Xilinx CoolRunner-II Automotive CPLDs are fabricated on a
0.18 micron process technology which is derived from lead-
ing edge FPGA product development. CoolRunner-II Auto-
motive CPLDs employ RealDigital a design technique that
makes use of CMOS technology in both the fabrication and
design
methodology.
RealDigital
design
technology
employs a cascade of CMOS gates to implement sum of
products instead of traditional sense amplifier methodology.
Due to this technology, Xilinx CoolRunner-II Automotive
CPLDs achieve both high-performance and low power
operation.
Supported I/O Standards
The CoolRunner-II Automotive 384-macrocell device fea-
tures LVCMOS and LVTTL I/O implementations. See
Table 1 for I/O standard voltages. The LVTTL I/O standard
is a general purpose EIA/JEDEC standard for 3.3V applica-
tions that use an LVTTL input buffer and Push-Pull output
buffer. The LVCMOS standard is used in 3.3V, 2.5V, 1.8V
applications. CoolRunner-II Automotive CPLDs are also
1.5V I/O compatible with the use of Schmitt-trigger inputs.
Table 1: I/O Standards for XA2C384
IOSTANDARD Attribute Output VCCIO Input VCCIO
LVTTL
3.3
LVCMOS33
3.3
LVCMOS25
2.5
LVCMOS18
1.8
LVCMOS15(1)
1.5
(1) LVCMOS15 requires Schmitt-trigger inputs.
Figure 1: ICC vs Frequency
Table 2: ICC vs Frequency (LVCMOS 1.8V TA = 25°C)(1)
Frequency (MHz)
0
255075
100
125
Typical ICC (mA)
0.023
17.5
35.03
52.53
70.03
87.53
Notes:
1.
16-bit up/down, Resetable binary counter (one counter per function block).
Frequency (MHz)
DS556_01_092106
I CC
(mA
)
0
50
100
25
75
125
50
相關PDF資料 |
PDF描述 |
|---|---|
| HMC35DRTN-S734 | CONN EDGECARD 70POS DIP .100 SLD |
| TAP226M016SCS | CAP TANT 22UF 16V 20% RADIAL |
| VE-B5V-CY-F3 | CONVERTER MOD DC/DC 5.8V 50W |
| VI-B12-CX-B1 | CONVERTER MOD DC/DC 15V 75W |
| 182-015-213R161 | CONN DB15 FEMAL .318" R/A NICKEL |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| XA2C64A-7VQG100I | 功能描述:IC CPLD 64MCELL 64 I/O 100-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:CoolRunner II 標準包裝:24 系列:CoolRunner II 可編程類型:系統(tǒng)內(nèi)可編程 最大延遲時間 tpd(1):7.1ns 電壓電源 - 內(nèi)部:1.7 V ~ 1.9 V 邏輯元件/邏輯塊數(shù)目:24 宏單元數(shù):384 門數(shù):9000 輸入/輸出數(shù):173 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:208-BFQFP 供應商設備封裝:208-PQFP（28x28） 包裝:托盤 |
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