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參數(shù)資料
| 型號(hào)： | XC2S100-5TQG144C |
| 廠(chǎng)商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 29/99頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC SPARTAN-II FPGA 100K 144-TQFP |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | Spartan®-II |
| LAB/CLB數(shù)： | 600 |
| 邏輯元件/單元數(shù)： | 2700 |
| RAM 位總計(jì)： | 40960 |
| 輸入/輸出數(shù)： | 92 |
| 門(mén)數(shù)： | 100000 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-TQFP（20x20） |
| 產(chǎn)品目錄頁(yè)面： | 599 (CN2011-ZH PDF) |
| 其它名稱(chēng)： | 122-1305 |
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Spartan-II FPGA Family: Functional Description
DS001-2 (v2.8) June 13, 2008
Module 2 of 4
Product Specification
35
R
Figure 33: Timing Diagram for Single-Port Block RAM Memory
Figure 34: Timing Diagram for a True Dual-Port Read/Write Block RAM Memory
DS001_33_061200
CLK
TBPWH
TBACK
ADDR
00
DDDD
MEM (00)
CCCC
MEM (7E)
0F
CCCC
7E
8F
BBBB
2222
DIN
DOUT
EN
RST
WE
DISABLED
READ
WRITE
READ
DISABLED
TBDCK
TBECK
TBWCK
TBCKO
TBPWL
DS001_34_061200
CLK_A
PORT
A
PORT
B
ADDR_A
00
7E
0F
00
7E
1A
0F
7E
AAAA
9999
AAAA
0000
1111
2222
AAAA
9999
AAAA
UNKNOWN
EN_A
WE_A
DI_A
DO_A
1111
2222
FFFF
BBBB
1111
AAAA
MEM (00)
9999
2222
FFFF
BBBB
UNKNOWN
CLK_B
ADDR_B
EN_B
WE_B
DI_B
DO_B
TBCCS
VIOLATION
TBCCS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XC2S100-5VQG100I | 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:Spartan-II FPGA Family |
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