參數(shù)資料
型號(hào): XC4013XL-3HT176C
廠(chǎng)商: Xilinx Inc
文件頁(yè)數(shù): 55/68頁(yè)
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描述: IC FPGA C 3.3V 3SPD 176HTQFP
產(chǎn)品變化通告: XC4000(XL,XLA,E) Discontinuation 15/Nov/2004
標(biāo)準(zhǔn)包裝: 40
系列: XC4000E/X
LAB/CLB數(shù): 576
邏輯元件/單元數(shù): 1368
RAM 位總計(jì): 18432
輸入/輸出數(shù): 145
門(mén)數(shù): 13000
電源電壓: 3 V ~ 3.6 V
安裝類(lèi)型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 176-LQFP 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝: 176-TQFP(24x24)
R
May 14, 1999 (Version 1.6)
6-63
XC4000E and XC4000X Series Field Programmable Gate Arrays
6
Figure 55: Master Parallel Mode Programming Switching Characteristics
Address for Byte n
Byte
2 TDRC
Address for Byte n + 1
D7
D6
A0-A17
(output)
D0-D7
RCLK
(output)
CCLK
(output)
DOUT
(output)
1 TRAC
7 CCLKs
CCLK
3 TRCD
Byte n - 1
X6078
Description
Symbol
Min
Max
Units
RCLK
Delay to Address valid
1
TRAC
0
200
ns
Data setup time
2
TDRC
60
ns
Data hold time
3
TRCD
0ns
Notes:
1. At power-up, Vcc must rise from 2.0 V to Vcc min in less than 25 ms, otherwise delay conguration by pulling PROGRAM
Low until Vcc is valid.
2. The rst Data byte is loaded and CCLK starts at the end of the rst RCLK active cycle (rising edge).
This timing diagram shows that the EPROM requirements are extremely relaxed. EPROM access time can be longer than
500 ns. EPROM data output has no hold-time requirements.
Product Obsolete or Under Obsolescence
相關(guān)PDF資料
PDF描述
XC4013XL-3HT144I IC FPGA I-TEMP 3.3V 3SPD 144HQFP
3-88637-1 CONN HOUSING STANDARD DUAL 60POS
IDT71V424YS15YGI IC SRAM 4MBIT 15NS 36SOJ
88190-2 CONN PLUG 38POS HSG W/DETENT
2-88637-7 CONN HOUSING STANDARD DUAL 50POS
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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XC4013XL-3HT176M 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:XC4000E and XC4000X Series Field Programmable Gate Arrays
XC4013XL3PQ160C 制造商:XIL 功能描述:XC4013XL-3PQ160C
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