參數(shù)資料
型號(hào)： XCV100E-6BG352I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 115/233頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 1.8V I-TEMP 352-MBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 24
系列： Virtex®-E
LAB/CLB數(shù)： 600
邏輯元件/單元數(shù)： 2700
RAM 位總計(jì)： 81920
輸入/輸出數(shù)： 196
門(mén)數(shù)： 128236
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 352-LBGA，金屬
供應(yīng)商設(shè)備封裝： 352-MBGA（35x35）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
115
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
FG900 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 27: FG900 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
GCLK LVDS
3
0
C15
A15
NA
IO_DLL_ 34N
2
1
E15
E16
NA
IO_DLL_ 34P
1
5
AK16
AH16
NA
IO_DLL_ 177N
0
4
AJ16
AF16
NA
IO_DLL_ 177P
IO LVDS
Total Pairs: 283, Asynchronous Output Pairs: 168
00
F7
C4
4
-
10
G8
D5
2
-
2
0
H9
A3
2
VREF
30
J10
B4
2
-
40
D6
A4
√
-
5
0
B5
E7
√
VREF
60
F8
A5
1
-
70
N11
D7
1
-
80
E8
G9
√
-
90
J11
A6
√
VREF
10
0
B7
C7
2
-
11
0
H10
C8
2
-
12
0
F10
G10
√
-
13
0
H11
A8
√
VREF
14
0
C9
D9
NA
-
15
0
J12
B9
4
-
16
0
A9
E10
NA
VREF
17
0
B10
G11
NA
-
18
0
C10
H12
4
-
19
0
F11
H13
2
-
20
0
D11
E11
2
-
21
0
G12
B11
2
-
22
0
C11
F12
√
-
23
0
D12
A10
√
VREF
24
0
A11
E12
1
-
25
0
B12
G13
1
-
26
0
K13
A12
√
-
27
0
B13
F13
√
VREF
28
0
E13
G14
2
-
29
0
B14
D14
2
-
30
0
J14
A14
√
-
31
0
J15
K14
√
VREF
32
0
H15
B15
NA
-
33
0
D15
F15
√
VREF
34
1
E16
A15
NA
IO_ LVDS_DLL
35
1
F16
B16
4
VREF
36
1
H16
A16
4
-
37
1
K15
C16
√
VREF
38
1
G16
K16
√
-
39
1
E17
A17
2
-
40
1
C17
F17
2
-
41
1
A18
E18
√
VREF
42
1
A19
D18
√
-
43
1
G18
B19
1
-
44
1
H18
D19
1
-
45
1
F19
F18
√
VREF
46
1
K17
B20
√
-
47
1
A20
D20
2
-
48
1
C20
G19
2
-
49
1
E20
K18
2
-
50
1
D21
B21
4
-
51
1
A21
F20
√
-
Table 27: FG900 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料
PDF描述
25C320-I/P IC EEPROM 32KBIT 3MHZ 8DIP
XA6SLX45-3FGG484Q IC FPGA SPARTAN 6 484FGGBGA
XA6SLX75-3FGG484I IC FPGA SPARTAN 6 74K 484FGGBGA
25C320-E/SN IC EEPROM 32KBIT 3MHZ 8SOIC
XC3S1500-4FG676I IC FPGA SPARTAN 3 676FBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XCV100E-6BG352I0773 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述:
XCV100E-6CS144C 功能描述:IC FPGA 1.8V C-TEMP 144-CSBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Virtex®-E 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門(mén)數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XCV100E-6CS144I 功能描述:IC FPGA 1.8V I-TEMP 144-CSBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Virtex®-E 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門(mén)數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XCV100E-6FG240C 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
XCV100E-6FG240I 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Field Programmable Gate Arrays
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