參數(shù)資料
型號： XCV200E-6BG352C
廠商： Xilinx Inc
文件頁數(shù)： 63/233頁
文件大?。?/td> 0K
描述： IC FPGA 1.8V C-TEMP 352-MBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標準包裝： 24
系列： Virtex®-E
LAB/CLB數(shù)： 1176
邏輯元件/單元數(shù)： 5292
RAM 位總計： 114688
輸入/輸出數(shù)： 260
門數(shù)： 306393
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 352-LBGA，金屬
供應(yīng)商設(shè)備封裝： 352-MBGA（35x35）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
69
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
FG676 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 21: FG676 Differential Pin Pair Summary
XCV400E, XCV600E
Pair
Ban
k
P
Pin
N
Pin
AO
Other
Functions
Global Differential Clock
3
0
E13
B13
NA
IO_DLL_L21N
2
1
C13
F14
NA
IO_DLL_L21P
1
5
AB13
AF13
NA
IO_DLL_L115N
0
4
AA14
AC14
NA
IO_DLL_L115P
IOLVDS
Total Pairs: 183, Asynchronous Output Pairs: 97
00
F7
C4
1
-
10
C5
G8
√
-
20
E7
D6
√
VREF
30
F8
A4
NA
-
40
D7
B5
NA
-
50
G9
E8
√
VREF
60
F9
A5
√
-
70
C7
D8
1
-
8
0
E9
B7
1
VREF
90
D9
A7
NA
-
10
0
G10
B8
NA
VREF
11
0
F10
C9
√
-
12
0
E10
A8
1
-
13
0
D10
G11
√
-
14
0
F11
B10
√
-
15
0
E11
C10
NA
-
16
0
D11
G12
√
-
17
0
F12
C11
√
VREF
18
0
E12
A11
√
-
19
0
C12
D12
1
-
20
0
H13
A12
1
VREF
21
1
F14
B13
NA
IO_LVDS_DLL
22
1
F13
E14
NA
-
23
1
A14
D14
1
VREF
24
1
H14
C14
1
-
25
1
C15
G14
√
-
26
1
D15
E15
√
VREF
27
1
F15
C16
√
-
28
1
D16
G15
-
29
1
A17
E16
√
-
30
1
E17
C17
√
-
31
1
D17
F16
1
-
32
1
C18
F17
√
-
33
1
G16
A18
√
VREF
34
1
G17
C19
√
-
35
1
B19
D18
1
VREF
36
1
E18
D19
1
-
37
1
B20
F18
√
-
38
1
C20
G19
√
VREF
39
1
E19
G18
√
-
40
1
D20
A21
√
-
41
1
C21
F19
√
VREF
42
1
E20
B22
√
-
43
1
D21
A23
2
-
44
1
E21
C22
√
CS
45
2
E23
F22
√
DIN, D0
46
2
E24
F20
√
-
47
2
G21
G22
2
-
48
2
F24
H20
1
VREF
49
2
E25
H21
1
-
50
2
F23
G23
√
-
51
2
H23
J20
√
VREF
Table 21: FG676 Differential Pin Pair Summary
XCV400E, XCV600E
Pair
Ban
k
P
Pin
N
Pin
AO
Other
Functions
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PDF描述
XA3SD1800A-4CSG484Q SPARTAN-3ADSP FPGA 1800K 484CSBG
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XCV200E6F256C 制造商:XILINX 功能描述:NEW
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