參數(shù)資料
型號： XCV200E-7FG256I
廠商： Xilinx Inc
文件頁數(shù)： 77/233頁
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描述： IC FPGA 1.8V I-TEMP 256-FBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 90
系列： Virtex®-E
LAB/CLB數(shù)： 1176
邏輯元件/單元數(shù)： 5292
RAM 位總計： 114688
輸入/輸出數(shù)： 176
門數(shù)： 306393
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FBGA（17x17）
Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
82
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
FG680 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 23: FG680 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
GCLK LVDS
3
0
A20
C22
NA
IO_DLL_L29N
2
1
D21
A19
NA
IO_DLL_L29P
1
5
AU22
AT22
NA
IO_DLL_L155N
0
4
AW19
AT21
NA
IO_DLL_L155P
IO LVDS
Total Pairs: 247, Asynchronous Output Pairs: 111
00
A36
C35
5
-
10
B35
D34
5
VREF
20
A35
C34
√
-
30
B34
D33
√
VREF
40
A34
C33
3
-
50
B33
D32
3
-
60
D31
C32
√
-
70
C31
A33
√
VREF
80
B31
B32
5
-
9
0
D30
A32
5
VREF
10
0
C30
A31
√
-
11
0
D29
B30
√
VREF
12
0
C29
A30
2
-
13
0
B29
A29
2
-
14
0
A28
B28
√
VREF
15
0
B27
C28
√
-
16
0
A27
D27
5
-
17
0
B26
C27
5
-
18
0
C26
D26
√
-
19
0
D25
A26
√
VREF
20
0
C25
B25
3
-
21
0
D24
A25
3
-
22
0
B23
A24
√
-
23
0
A23
C24
√
VREF
24
0
B22
B24
5
-
25
0
A22
E23
5
-
26
0
B21
D23
√
-
27
0
A21
C23
√
VREF
28
0
B20
E22
2
-
29
1
A19
C22
NA
IO_LVDS_DLL
30
1
B19
C21
2
VREF
31
1
A18
C19
2
-
32
1
B18
D19
√
VREF
33
1
A17
C18
√
-
34
1
B17
D18
5
-
35
1
A16
E18
5
-
36
1
D17
C17
√
VREF
37
1
E17
B16
√
-
38
1
C16
A15
3
-
39
1
D16
B15
3
-
40
1
B14
A14
√
VREF
41
1
A13
C15
√
-
42
1
B13
D15
5
-
43
1
A12
C14
5
-
44
1
C13
D14
√
-
45
1
D13
B12
√
VREF
46
1
C12
A11
2
-
47
1
C11
B11
2
-
48
1
D11
A10
√
VREF
49
1
C10
B10
√
-
50
1
D10
A9
5
VREF
51
1
C9
B9
5
-
Table 23: FG680 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
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PDF描述
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