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參數(shù)資料
| 型號： | XCV400E-6BG560I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 48/233頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1.8V I-TEMP 560-MBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex®-E |
| LAB/CLB數(shù)： | 2400 |
| 邏輯元件/單元數(shù)： | 10800 |
| RAM 位總計： | 163840 |
| 輸入/輸出數(shù)： | 404 |
| 門數(shù)： | 569952 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 560-LBGA，金屬 |
| 供應(yīng)商設(shè)備封裝： | 560-MBGA（42.5x42.5） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
55
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
7IO
J1
7IO
J4
7IO
L21
7
IO_L104N_YY
L3
7
IO_L104P_YY
L4
7
IO_L105N_YY
L5
7
IO_L105P_YY
L1
7
IO_L106N_Y
L6
7
IO_L106P_Y
K2
7
IO_L107N_Y
K4
7
IO_VREF_L107P_Y
K3
7
IO_L108N_YY
K1
7
IO_L108P_YY
K5
7
IO_L109N_YY
J3
7
IO_L109P_YY
J2
7
IO_L110N_YY
J5
7
IO_L110P_YY
H1
7
IO_L111N_YY
H2
7
IO_L111P_YY
H3
7
IO_L112N_Y
G1
7
IO_VREF_L112P_Y
H4
7
IO_L113N_Y
F1
7
IO_L113P_Y
F2
7
IO_L114N_YY
H5
7
IO_L114P_YY
G3
7
IO_L115N_YY
E1
7
IO_VREF_L115P_YY
E2
7
IO_L116N_YY
F3
7
IO_L116P_YY
G5
7
IO_L117N_YY
E3
7
IO_VREF_L117P_YY
D2
7
IO_L118N_YY
F5
7
IO_L118P_YY
C1
2CCLK
B22
3DONE
Y19
NA
DXN
Y5
Table 18: FG456 — XCV200E and XCV300E
Bank
Pin Description
Pin #
NA
DXP
V6
NA
M0
AB2
NA
M1
U5
NA
M2
Y4
NA
PROGRAM
W20
NA
TCK
C4
NA
TDI
B20
2TDO
A21
NA
TMS
D3
NA
NC
W19
NA
NC
W4
NA
NC
D19
NA
NC
D4
NA
VCCINT
E5
NA
VCCINT
E18
NA
VCCINT
F6
NA
VCCINT
F17
NA
VCCINT
G7
NA
VCCINT
G8
NA
VCCINT
G9
NA
VCCINT
G14
NA
VCCINT
G15
NA
VCCINT
H7
NA
VCCINT
G16
NA
VCCINT
H16
NA
VCCINT
J7
NA
VCCINT
J16
NA
VCCINT
P7
NA
VCCINT
P16
NA
VCCINT
R7
NA
VCCINT
R16
NA
VCCINT
T7
NA
VCCINT
T8
NA
VCCINT
T9
NA
VCCINT
T14
Table 18: FG456 — XCV200E and XCV300E
Bank
Pin Description
Pin #
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HSC17DTEI | CONN EDGECARD 34POS .100 EYELET |
| HMC17DTEI | CONN EDGECARD 34POS .100 EYELET |
| ACB55DHBN | CONN EDGECARD 110PS R/A .050 DIP |
| ACB55DHBD | CONN EDGECARD 110PS R/A .050 DIP |
| AGM40DTMS | CONN EDGECARD 80POS R/A .156 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCV400E-6FG240C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
| XCV400E-6FG240I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
| XCV400E-6FG676C | 功能描述:IC FPGA 1.8V C-TEMP 676-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計:4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
| XCV400E-6FG676I | 功能描述:IC FPGA 1.8V I-TEMP 676-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計:4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
| XCV400E-6HQ240C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
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